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M390S2858CT1
PC133注册DIMM
与PLL &寄存器（ CL = 2 ， BL = 4 ）标准时序图
*2
*1
控制信号（ RAS ， CAS ， WE）
REG
*3
D
OUT
* 1 。注册输入
0
CLK
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
RAS
CAS
WE
* 2 。寄存器输出
RAS
td
tr
td
tr
CAS
WE
* 3 。 SDRAM
CAS等待时间（参见* 1）
=2CLK+1CLK
TSAC
TRAC （参照* 1）
1CLK
DQ
TRAC （参照* 2）
Qa0
Qa1
Qa2
Qa3
Db0
Db1
Db2
Db3
CAS等待时间（参见* 2）
=2CLK
TRDL
行活动
读
命令
预充电
命令
行活动
写
命令
预充电
命令
TD ， TR =寄存器的延迟（ 74ALVCF162835 ）
注意事项：
1.如遇模块时序，指令周期延迟1CLK相对于外部输入时序的地址和输入信号
由于寄存器（ 74ALVCF162835 ）的缓冲。因此，读/写功能的输入/输出信号应
发行1CLK早些时候相比，非缓冲DIMM 。
2. D
IN
是要写入命令后，由于D外部定时发出1clock
IN
直接发给模块。
：唐
′t
CARE
REV 。 2001年九月0.1
