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如果容差是太高，速率值达到前，和速率值可以是
不稳定的（太大步） 。
如果容差是太低了，这可能是难以赶上的数据和函数
可能会丢失。
注意到两个数据转变之间的最大可接受的距离取决于
精密DATARATE与发射器的实际数据速率。
同步机制与记时下文说明。该synchroni-
矩阵特殊积做是为第一位。在最坏的情况下，当数据和时钟到达
同时，它开始于所述第二位。注意， DATACLK信号可作为
一旦DATACLK位被编程，无论DATAMSG引脚的状态。
编程的数据速率允许创建一个基本的时钟以编程DAT-
独的频率在接收的开始。然后，时钟，如果移位
必要的公差值，根据以前的数据转换：将
钟后或更早提出，取决于时钟和数据之间的差距。
例如：
如果DATARATE = 50 kbps的，这相当于1比特的持续时间为200× T，同
T = 100纳秒=基本时钟周期。
如果DATATOL = 2 ％× DATARATE = 4× T。
图34 。
时钟恢复
DATAMSG
200T
DATACLK
预期
价值
与DATAMSG同步值
预期
价值
TOL = 4T
TOL = 4T
DATARATE编程
该值必须仅编程时，数据时钟，需要在DATACLK
芯片的输出引脚。
该数据速率可以从1 kbps的被编程为64kbps且CTRL2的14位
注册。
DATARATE是数据速率的周期，并且可以用一个分辨率进行编程
鉴于由晶体振荡器周期：
10.245 MHz振荡器，周期为T = 97.6纳秒
20.945 MHz振荡器，周期为T = 95.5纳秒
有些数据速率值与给定例如10.245 MHz振荡器：
DATARATE [13 ：0]的
(160)
10
(205)
10
(vv)
10
(534)
10
(1024)
10
率
64 Kbps的
50 kbps的
……
19.2 kbps的
10 kbps的
期
1位 160 x深
1位 205 x深
1位 VV x深
1位 534 x深
1位 1024 x深
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AT86RF211
1942C–WIRE–06/02
