TQ6124
功能说明
该TQ6124登记在主锁存器的输入位
数组。四个最显著位的值是
编码成n - 15的温度计代码，而10
低位通不过的均衡延时阶段。所有
25位被重新登记在一个25级从锁存器阵列
它驱动一组25个差分对开关。这些
开关操纵相应的段和位
电流成真（V
O
）和补充（ NV
O
)
输出。该架构通过最大限度地减少故障的冲动
消除了大量中等规模的电流转换。
最-显著位生成的段
电流，这是相等重量的
1
/
16
在全中
量程输出（I
FS
） 。在10低阶比特进行分割
分为两个亚组。这三个中间位掌舵
震级我二进制加权电流
FS
/32, I
FS
/64
我
FS
/ 128的输出。七个最不显著
位相同的转向我
FS
/ 128的电流转换为差分
R-2R梯形产生的我有效位电流
FS
/256
到我
FS
/ 16384 。 DAC输出的总和
段和低阶位的输出。
时钟和数据输入是ECL兼容。输出
被设计成操作为50Ω负载，与内部
通过所提供的反向端接地
R- 2R网络。
外部补偿被用于最小化的效果
设备不匹配。外部运算放大器感应总和
段，中间位和低位的电流。
图2. TQ6124电流
段1直通15
V
O
NV
O
Q
I
D9
NQ
1.25mA
2.5mA
I
D8
.625mA
I
D7
DUMMY
I
D6
.3125mA
(x8)
DUMMY
.3125mA
以交换机为D0通D9
0.3125毫安0.3125毫安
V
REF
V
SENSE
R
SENSE
5.8K
R
来源
1.2K
R
SENSE
5.8K
R
来源
1.2K
V
AA
R
SENSE
5.8K
R
来源
1.2K
MID_trim
LSB_trim
2
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