TQ8105/TQ8106
初步数据表
表1.信号说明
（续）
针
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
信号
CLRLOS
RLOCK
LBM1
GND
LBM0
VDD
诺埃
GND
n重设
OC3
彩信
CKSRC2
CKSRC1
CKSRC0
PH1
PH0
VDD
SVDD
GND
MXD0
MXD1
MXD2
MXD3
MXD4
MXD5
MXD6
MXD7
VCC
TXBC
DGND
SONETCK
VCC
SDHCK
DGND
LOR
AGND
FP2
FP1
AVDD
VDD
REFCKT
GND
NC / NCDREN *
功能
TTL输入
三态输出TTL
TTL输入
GND
TTL输入
+5V
TTL输入
GND
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
+5V
+5V
GND
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
TTL输入
+5V/+3.3V
三态输出TTL
GND
三态输出TTL
+5V/+3.3V
三态输出TTL
GND
三态输出TTL
模拟地
模拟输出
模拟量输入
模拟+ 5V
+5V
TTL输入
GND
TTL输入
描述
高电平有效清除LOS输出
接收时钟满足锁定条件时，高
环回模式控制（见表3）
核心地
环回模式控制（见表3）
核心正电源
TTL三态控制（低电平有效使能）
核心地
全局复位（低有效）
OC3 / OC12模式选择
主/从模式控制
时钟源选择（见表3）
时钟源选择（见表3）
时钟源选择（见表3）
TxBC相位选择（见表3）
TxBC相位选择（见表3）
核心正电源
输出驱动器内部正电源
核心地
多路数据位0 （ LSB ）
多路数据位1
多路数据位2
多路数据位3
多路数据位4
多路数据位5
多路数据位6
多路数据位7 （ MSB ）
TTL驱动正电源
发送字节时钟
TTL驱动器地
51.84 MHz的时钟输出
TTL驱动正电源
38.88 MHz的时钟输出
TTL驱动器地
表示参考时钟不存在
VCO模拟地
发射PLL环路滤波器，电荷泵输出
发射PLL环路滤波器，压控振荡器调谐
VCO &滤波器模拟VDD电源
核心正电源
TX参考时钟或绕道时钟
核心地
内部上拉，低= CDR接收时钟;浮= 17/18引脚接收的Clk
（由TQ8105忽略）
注：* TQ8106的特定信号
6
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