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IDT72T1845 / 55 /65 /八十五分之七十五/一百〇五分之九十五/一百二十五分之一百一十五2.5V TeraSync 18位/ 9位的FIFO
2Kx18 / 4Kx9 , 4Kx18 /
8Kx9 , 8Kx18 / 16Kx9 , 16Kx18 / 32Kx9 , 32Kx18 / 64Kx9 , 64Kx18 / 128Kx9 , 128Kx18 / 256Kx9 , 256Kx18 / 512Kx9 , 512Kx18 / 1Mx9
商业和工业
温度范围
FWFT / SI
传输时钟
写时钟
写使能
输入就绪
FWFT / SI
WCLK
IR
FWFT / SI
RCLK
OR
RCS
OE
Qn
GND
n
WCLK
IR
RCLK
RCS
OR
OE
Qn
5909 drw41
读时钟
DATA IN
n
Dn
IDT
72T1845
72T1855
72T1865
72T1875
72T1885
72T1895
72T18105
72T18115
72T18125
Dn
IDT
72T1845
72T1855
72T1865
72T1875
72T1885
72T1895
72T18105
72T18115
72T18125
读片选
读使能
输出就绪
OUTPUT ENABLE
n
数据输出
深度扩展的图37.框图
对于X18的输入或输出X18总线宽度:
4096 ×18 , 8192 ×18 , 16,384 ×18 , 32,768 ×18 , 65,536 ×18 , 131,072 ×18 , 262,144 ×18 , 524,288 ×18和1048576 ×18
对于这两种X9输入和输出X9总线宽度:
8,192 ×9 , 16,384 ×9 , 32,768 ×9 , 65,536 ×9 , 131,072 ×9 , 262,144 ×9 , 524,288 ×9 , 1,048,576 ×9和2,097,152 ×9
深度扩展配置( FWFT模式)
该IDT72T1845能容易地适应于需要深度的应用
当选择了输入×18 ×18或输出总线宽度大于2048 , 4096
为IDT72T1855 , 8,192为IDT72T1865 , 16,384为IDT72T1875 ,
32,768为IDT72T1885 , 65,536为IDT72T1895 , 131,072为
IDT72T18105 , 262,144为IDT72T18115和524,288的
IDT72T18125 。当两个输入X9 X9和输出的总线宽度选择,
深度大于4096可适于在IDT72T1845 , 8192为
IDT72T1855 , 16,384为IDT72T1865 , 32,768为IDT72T1875 ,
65,536为IDT72T1885 , 131,072为IDT72T1895 , 262,144为
IDT72T8105 , 524,288为IDT72T18115和1,048,576的
IDT72T18125 。在FWFT模式下,FIFO可以被串联的数据连接(
1 FIFO相连的下一个输入的数据)的,没有外部的输出
必要的逻辑。由此产生的配置提供了总深度相当于
到与每个单个的FIFO相关联的深度的总和。图37示出了
使用深度扩展2 IDT72T1845 / 72T1855 / 72T1865 / 72T1875 /
72T1885 / 72T1895 / 72T18105 / 72T18115 / 72T18125设备。
应注意在主复位所有FIFO的选择FWFT模式
在深度扩展配置。写入到一个空的第一个字
配置将通过从一个FIFO进入下一个( "ripple down" ),直到最后
出现在最后的FIFO的链中的输出 - 无读取操作
必要的,但每个FIFO的RCLK必须是自由运行的。每次数据
字出现在同一FIFO的输出端,该设备的
OR
线变为低电平,
使写行中的下一个FIFO中。
对于一个空扩展配置,所需的时间量所花费
OR
of
在链中的最后一个FIFO中变为低电平(即有效数据出现在最后的FIFO的
输出)后一个字被写入第一FIFO的延迟的总和
对于每个单独的FIFO :
(N - 1)* (4 *传送时钟)+ 3 * T
RCLK
其中,N是FIFO中,在膨胀和T的数目
RCLK
是RCLK周期。
需要注意的是额外的周期应为的可能性吨被添加
SKEW1
说明书并不WCLK和传送时钟,或RCLK和转印之间遇到
时钟,对
OR
FL AG 。
该"ripple down"延迟是唯一明显的写入到一个空的第一个字
深度扩展配置。将不会有明显的延迟为后续
字写的配置。
从一个完整的深度扩展阅读创建的第一个空闲位置
配置将"bubble up"从最后的FIFO到前一个,直到它最后
移动到该链的第一FIFO 。一个自由位置是在一个建立的每个时间
FIFO中的链,即先进先出的
IR
线变为低电平,使前述的FIFO
写一个字来填充它。
对于一个完整的膨胀结构中,所需的时间量所花费
IR
第一
FIFO的链中的一个字后变为低电平已读出的最后的FIFO是
延迟为每个单独的FIFO的总和:
(N - 1 ) * ( 3 *传送时钟) + 2 T
WCLK
其中,N是FIFO中,在膨胀和T的数目
WCLK
是WCLK
期。需要注意的是额外的周期应为的可能性吨被添加
SKEW1
说明书并不RCLK和传送时钟,或WCLK和转印之间遇到
时钟,对
IR
FL AG 。
传送时钟线应该连接到任何WCLK和RCLK为准
是更快的。这两个操作导致数据移动,尽可能快地,向
链的端部和自由位置,以链的开头。
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