飞思卡尔半导体公司
四定时器模块信号
2.13四定时器模块信号
表18四定时器模块信号
数
引脚
2
信号
名字
TC0-1
信号
TYPE
输入/
产量
输入/
产量
国家在
RESET
输入
信号说明
TC0
–
1—Timer
C型通道0和1
4
TD0-3
输入
TD0
–
3—Timer
D通道0 ， 1，2，和3中
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2.14 JTAG /次
表19. JTAG /片上仿真（一次）信号
数
引脚
1
信号
名字
TCK
信号
TYPE
输入
（施密特）
国家在
RESET
输入，拉
内部低
信号说明
测试时钟输入，这
输入引脚提供了一个门控时钟
同步测试逻辑和串行数据转移到JTAG /一次
端口。该引脚在内部连接到一个下拉电阻。
1
TMS
输入
输入，拉
测试模式选择输入，这
输入引脚用于测序
（施密特）高内部JTAG TAP控制器的状态机。它的上升沿采样
TCK的边缘，有一个上拉电阻。
输入
输入，拉
测试数据输入，这
输入引脚提供串行输入数据流
（施密特）高内部的JTAG /次端口。据采样于TCK的上升沿和
有一个上拉电阻。
产量
三态
测试数据输出，这
三态输出引脚提供串行
输出数据流从JTAG /次端口。它被驱动
移-IR和移位-DR控制器状态，并在下降沿变化
TCK的边缘。
1
TDI
1
TDO
1
TRST
输入
输入，拉
测试复位，由于
输入时，该引脚上的低信号，提供一个复位
（施密特）高内部信号的JTAG TAP控制器。为了确保完整的硬件
复位， TRST信号必须保持在上电时，每当复位
为有效。在调试环境出现唯一的例外
当一个硬件设备复位，需要和有必要不
重置一次/ JTAG模块。在这种情况下，断言复位，但这样做
不能断言TRST 。
产量
产量
调试事件-DE
提供认可调试一个低脉冲
事件。
1
DE
56F805技术数据
欲了解更多有关该产品，
转到： www.freescale.com
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