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MC-4R512FKK6K
信号
ROW2_THRU_R..
ROW0_THRU_R
SCK_THRU_L
模块
接口垫
A52 ， B50 ， A50
I / O
I
TYPE
RSL
描述
行总线。含有控制和地址信息的3位总线
为行访问。连接到"Thru"权RDRAM设备
通道。
串行时钟输入。时钟源用于读取和写入
以"Thru"通道RDRAM控制寄存器。连接到左
在"Thru"通道RDRAM设备。
串行时钟输入。时钟源用于读取和写入
以"Thru"通道RDRAM控制寄存器。连接到正确的
在"Thru"通道RDRAM设备。
"Thru"通道串行I / O的读取和写入
控制寄存器。重视权RDRAM设备上SIO0
"Thru"通道。
"Thru"通道串行I / O的读取和写入
控制寄存器。重视离开RDRAM设备SIO1上
"Thru"通道。
时钟的主。连接到正确的RDRAM设备
"Term"通道。接口时钟用于接收RSL
来自控制器的信号。正极性。
时钟的主。连接到正确的RDRAM设备
"Term"通道。接口时钟用于接收RSL
来自控制器的信号。负极性。
使用串行指令输入读取和写入
控制寄存器。也可用于电源管理。
连接到"Term"通道RDRAM的权利设备。
"Term"频道栏目总线。含控制5位总线和
地址信息栏访问。连接到正确的
在"Term"通道RDRAM设备。
时钟掌握。连接上"Term"左RDRAM设备
通道。接口时钟用于发送的RSL信号
控制器。正极性。
时钟掌握。连接到"Term"权RDRAM设备
通道。接口时钟用于发送的RSL信号
控制器。正极性。
时钟掌握。连接上"Term"左RDRAM设备
通道。接口时钟用于发送的RSL信号
控制器。负极性。
时钟掌握。连接到"Term"权RDRAM设备
通道。接口时钟用于发送的RSL信号
控制器。负极性。
"Term"通道数据总线A. 9位总线背着一个字节
读取或写入控制器和RDRAM的设备之间的数据
在“期限”频道。连接到正确的RDRAM设备
"Term"通道。 DQA8_TERM是模块非功能。
"Term"通道数据总线B. 9位总线背着一个字节
读取或写入控制器和RDRAM的设备之间的数据
在“期限”频道。连接到正确的RDRAM设备
"Term"通道。 DQB8_TERM是模块非功能。
"Term"通道行总线。含控制3位总线和
地址信息的行访问。连接到正确的
在"Term"通道RDRAM设备。
串行时钟输入。时钟源用于读取和写入
以"Term"通道RDRAM控制寄存器。连接
在"Term"通道RDRAM的权利设备。
"Term"通道串行I / O的读取和写入
控制寄存器。重视离开RDRAM设备上SIO0
"Term"通道。
"Term"通道终止电压。
A2
I
Vcmos
SCK_THRU_R
A71
I
Vcmos
SIN_THRU
B34
I / O
Vcmos
SOUT_THRU
A34
I / O
Vcmos
CFM_TERM
B103
I
RSL
CFMN_TERM
B101
I
RSL
CMD_TERM
COL4_TERM..
COL0_TERM
CTM_TERM_L
A115
I
Vcmos
B97 ， A97 ， B95 ， A95 ，
I
B93
B73
I
RSL
RSL
CTM_TERM_R
A103
I
RSL
CTMN_TERM_L
B71
I
RSL
CTMN_TERM_R
A105
B113 ， A113 ， B111 ，
A111 ， B109 ， A109 ，
B107 ， A107 ， B105
I
RSL
DQA8_TERM..
DQA0_TERM
I / O
RSL
DQB8_TERM..
DQB0_TERM
ROW2_TERM..
ROW0_TERM
SCK_TERM
A85 ， B85 ， A87 ， B87 ，
A89 ， B89 ， A91 ， B91 ， I / O
A93
A101 ， B99 ， A99
I
RSL
RSL
B115
I
Vcmos
SIN_TERM
VTERM
B83
A60 ， B60 ， A61 ， B61
I / O
Vcmos
初步数据表E0267N10 （版本1.0 ）
5
