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飞利浦半导体
初步数据
2端口/ 1端口400 Mbps的物理层接口
PDI1394P23
18.4发送
当有限责任公司发出过LREQ终端总线请求，
PHY仲裁获得总线的控制权。如果在PHY赢得仲裁
用于串行总线时，PHY - LLC接口总线被授予该链路
对CTL端子1断言格兰特状态（ 11B ）
SYSCLK周期，接着空闲为一个时钟周期。该LLC则
需要通过触发总线的控制权或者空闲（ 00B ） ，保持（ 01B ） ，或
发送（ 10b）的上的CTL端子。除非LLC立即
释放接口，链路可以断言空闲状态时，在最
一个时钟前，必须断言或者保留或传输的CTL
终端。保持状态被用于由LLC保留的控制
总线而它准备用于传输的数据。该LLC可以断言
保持零个或多个时钟周期（即LLC不必断言
发射前举行） 。在PHY断言上的串行数据字头
在此期间，总线。
当LLC准备发送数据时， LLC声称对发射
在CTL端子以及发送的分组数据的第一比特上
对D线。在发送状态被保持在CTL端子，直到
数据的最后位已发送。该LLC则断言或者保留或
闲置的CTL端子的一个时钟周期，然后断言空闲
对于一个附加周期之前释放所述接口总线与
把在CTL和D端子处于高阻抗状态。该
PHY之后能恢复到接口总线的控制权。
保持状态，宣称在年底的数据包传输指示
到了LLC请求发送一个数据包的PHY
（连续包），而不释放该串行总线。该PHY
通过等待所需的响应该请求，并置
最小包间隔时间，然后声称格兰特为
前。此功能可以用于以后发送一个统一的响应
发送一个确认，或发送连续的同步
在一个同步周期的数据包。除非多速
串联启用，在一个总线上传输的所有数据包
所有权必须是相同的速度（自的速度
包的第一个数据包之前设置） 。如果多速串联是
启用时（ PHY寄存器5的紧急监援中心位被置位） ，有限责任公司应当
指定在D的下一个连接的分组的速度代码
当它声称保留对CTL端子处的结束端
数据包。对于此速度代码的编码是一样的速度
如在表19中给出了前面接收的分组数据的代码。
发送的最后分组的当前总线所有权，在LLC之后
通过认定闲置的CTL端子两个时钟释放总线
周期。物理层开始断言空闲的CTL端子1
从链路采样空闲后时钟。注意，每当在D和
的CTL端子在PHY和LLC之间改变方向，
有允许一个额外的时钟周期，使两侧的
接口可以对接口信号的注册版本进行操作。
事件的正常分组传输的顺序为
如下所示：
发送操作开始。该PHY断言授予的CTL
线后闲置交出接口控制
链路，使得链路可以传输数据包。该PHY版本
接口控制（也就是说，它的3国CTL和D输出）
下面的空闲周期。
可选的空闲周期。该链路可以断言至多一个空闲周期
前面的任何持有或发送断言。此空闲周期
可选;断言前述任一空闲链路不要求
持有或传送。
可选持有周期。该链接可以断言保持长达47个周期
前发射的说法。这些保持周期（S ）是可选的;
链路不需要断言保持前述发送。
传输数据。当数据准备好被发送时，链路
断言发送的CTL系连同在D中的数据
线。
发送操作终止。发送操作
通过链接的认定持有或终止闲置的CTL线
链路断言持有以指示所述PHY是保留的控制
串行总线，以便发送一个连接的分组。链接
断言空闲，指示数据包传输的完整性和
物理层可以释放该串行总线。该链接，然后断言空闲的
一个周期下保持或闲置释放之前，这个周期
接口和返回控制的PHY 。
级联数据包的速度码。如果多速串联是
在PHY端口，链路主张应在D的速度码
线时，它声称保留终止分组传输。这
速度代码指示用于传输速度
连接的分组是跟随。此编码
连接的分组速码是相同的编码
所接收的分组的快速代码（见表19）。该链接可能不
串联的S100包到任何更高速度的数据包。
恢复接口的控制后， PHY应认定为
至少有空闲的一个周期的任何后续状态转移之前，
接收操作，或发送操作。
系统时钟
(a)
(b)
(c)
(d)
00
00
11
00
00
01
10
01
(f)
00
00
00
d0, d1, ...
dn
SPD
00
00
00
00
(e)
(g)
CTL0 ， CTL1
D0–D7
链路控制CTL和D
PHY高阻抗CTL和D输出
SV01762
注意：
SPD =速度的代码;见表19 ; D0 - DN =分组数据。
图18.正常数据包发送时序
2001年9月6日
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