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ST72260G ， ST72262G ， ST72264G
引脚n °
TYPE
SDIP32
SO28
BGA
引脚名称
水平
产量
输入
接口/控制
输入
FL燕麦
WPU
ANA
INT
OD
PP
主
输出功能
（后
复位）
X
X
X
X
T
X
T
X
X
X
X
X
C2口
C1口
端口C0
端口A7
端口A6
端口A5
端口A4
备用功能
17
18
19
20
21
22
23
24
25
15 E3 PC2 / MCO / AIN2
16 F4 PC1 / OCMP1_B / AIN1
17 D3 PC0 / ICAP1_B / AIN0
18 E4 PA7 / TDO
19 F5 PA6 / SDAI
20 F6 PA5 / RDI
21 E6 PA4 / SCLI
E5 NC
D6 NC
D5 NC
I / O
I / O
I / O
C
T
C
T
C
T
X
Ei0 / EI1 X
X
Ei0 / EI1 X
X
Ei0 / EI1 X
X
X
X
X
ei0
ei0
ei0
ei0
主时钟输出（六
中央处理器
）或
ADC模拟输入2
定时器B输出比较1
ADC模拟输入1
定时器B输入捕捉1
ADC模拟输入0
SCI输出
I
2
C数据
SCI输入
I
2
时钟
I / O
T
HS
I / O
T
HS
I / O
T
HS
I / O
T
HS
没有连接
26
27
22 C6 PA3
23 D4 PA2
C5 NC
I / O
T
HS
I / O
T
HS
X
X
ei0
ei0
X
X
X
X
端口A3
口A2
没有连接
B6 NC
28
29
30
31
32
24 A6 PA1 / ICCDATA
25 A5 PA0 / ICCCLK
26 B5 ICCSEL
27 A4 V
SS
28 B4 V
DD
I / O
T
HS
I / O
T
HS
I
S
S
C
T
X
X
X
ei0
ei0
X
X
X
X
端口A1
端口A0
在电路通信数据
在电路通信
时钟
ICC模式引脚，必须绑低
地
主电源
注意事项：
1.在中断输入栏， “ EIX ”定义了相关的外部中断向量。如果弱上拉
列（ WPU ）合并与中断列（ INT ） ，那么I / O配置为上拉中断输入
放，否则该结构是浮动的中断输入。端口C被映射到ei0或通过选项字节EI1 。
2.在开漏输出列， “T”定义了一个真正的开漏I / O （ P-缓冲和保护二极管V
DD
未实现） 。看
第38页的第9 "I / O PORTS"
了解更多详情。
3. OSC1和OSC2引脚连接一个晶体或陶瓷谐振器，外接RC或外部源
片上振荡器看
第6页第2 "PIN DESCRIPTION"
和
第6.2节"MULTI ，振荡
TOR （ MO） "第21页
了解更多详情。
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