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XC164
衍生产品
功能说明
3.15
时钟发生器
时钟产生单元采用了可编程的片上PLL与多个预分频器
以生成用于与高灵活性的XC164的时钟信号。主时钟
f
MC
is
基准时钟信号，并用于TwinCAN并输出到外部系统。
CPU时钟
f
中央处理器
与系统时钟
f
SYS
来源于主时钟或者
直接地（1： 1 ），或通过一个2： 1的预分频器（
f
SYS
=
f
中央处理器
=
f
MC
/ 2）。另请参阅
第5.1节。
片上振荡器可以驱动外部晶体或接受外部时钟信号。
振荡器的时钟频率可以由片上PLL相乘（通过可编程
因子），或者可以通过一个可编程的分频因子进行划分。
如果旁路模式时（直接驱动器或预分频器）的PLL能够提供一个独立的
时钟监视由内部振荡器产生的时钟信号。这PLL时钟
独立于XTAL1时钟。当预期的振荡器时钟转换是
缺少振荡器看门狗（ OWD ）激活PLL解锁/ OWD中断节点
供给CPU的一个紧急时钟， PLL时钟信号。在这些
情况下， PLL会振荡，其基本频率。
该振荡器的看门狗可以被禁用
通过切换PLL关闭。这降低了功耗
消费，也没有中断请求的情况下缺失的产生
振荡器时钟。
注意：在一个外部复位结束时（EA ='0' ）的振荡器看门狗可能被禁用
通过由（外部）硬件拉动RD线为低电平时复位，类似于
标准复位配置。
3.16
并行端口
该XC164提供了多达它们分为六个输入/输出端口79 I / O线
和一个输入端口。所有端口线可位寻址，所有的输入/输出线
分别（按位）作为可编程通过方向寄存器输入或输出。在I / O
端口是切换时的高阻抗状态，真正的双向口
配置为输入。的一些I / O端口的输出驱动器可以被配置（由销针）
通过控制寄存器推/拉操作或漏极开路操作。在内部
复位后，所有端口引脚配置为输入（除销RSTOUT ） 。
边缘特征（形状）以及端口的驱动特性（输出电流）
司机可以通过寄存器POCONx来选择。
有端口的输入阈值是可选择的（ TTL或像CMOS ），其中，所述特殊
像输入阈值的CMOS减小噪声灵敏度由于输入滞后。该
输入阈值可以被单独地选择为各端口的每一个字节。
所有端口线有关联的可编程复用输入或输出功能
他们。未用于这些复用功能的所有端口线可以用作一般
通用IO线。
数据表
39
V2.1, 2003-06
