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Ultra37000 CPLD系列
逻辑框图
（续）
CY37256 / CY37256V （ 256引脚BGA）
时钟/
INPUT输入
1
4
4
I / O
0
-I / O
11
12个I / O的
12个I / O的
I / O
12
-I / O
23
I / O
24
-I / O
35
I / O
36
-I / O
47
I / O
48
-I / O
59
I / O
60
-I / O
71
I / O
72
-I / O
83
12个I / O的
12个I / O的
逻辑
块
A
逻辑
块
B
逻辑
块
C
逻辑
块
D
逻辑
块
E
逻辑
块
F
逻辑
块
G
逻辑
块
H
96
TDO
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
36
16
4
逻辑
块
P
逻辑
块
O
逻辑
块
N
逻辑
块
M
逻辑
块
L
逻辑
块
K
逻辑
块
J
逻辑
块
I
96
12个I / O的
I / O
180
-I / O
191
12个I / O的
I / O
168
-I / O
179
12个I / O的
I / O
156
-I / O
167
12个I / O的
I / O
144
-I / O
155
12个I / O的
I / O
132
-I / O
143
12个I / O的
I / O
120
-I / O
131
12个I / O的
I / O
108
-I / O
119
12个I / O的
I / O
96
-I / O
107
12个I / O的
12个I / O的
PIM
36
16
36
16
36
16
36
16
12个I / O的
12个I / O的
I / O
84
-I / O
95
TDI
TCK
TMS
JTAG TAP
调节器
文件编号： 38-03007牧师* D
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