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莱迪思半导体公司
图2.通用逻辑块
CLK0
CLK1
CLK2
CLK3
的ispMACH 4000V / B / C / Z系列数据手册
要GRP
时钟
发电机
1+OE
16 MC反馈信号
1+OE
1+OE
1+OE
1+OE
1+OE
1+OE
1+OE
到ORP
To
产品期限
OUTPUT ENABLE
分享
逻辑分配器
36输入
从GRP
和阵列
可编程与阵列由36个输入和83输出的乘积项。从GRP 36输入是
用于形成在与阵列72线（真和互补的输入）。数组中的每个线可以CON组
连接至任意的83输出的乘积项经由有线与。每个80逻辑乘积项进给逻辑
分配器用剩下的三个控制产品条款喂养共享PT时钟，共享PT初始化和
共享PT OE 。共享PT时钟和共享PT初始化信号可以选择是前倒
馈送到宏单元。
每一套
OVE
从80年代的逻辑乘积项的乘积项形成开始PT0一个乘积项群。
有在GLB每个宏单元1乘积项簇。图3是与的图形表示
数组。
和阵列
36输入，
83产品条款
4
16宏单元
