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Delta39K ISR
CPLD系列
GCLK [3 ：0]的
PLL和时钟MUX
GCTL [3 ：0]的
4
4
GCLK [3 ：0]的
4
I / O块7
4
4
I / O组6
4
LB 0
LB 1
LB 2
LB 3
簇
内存
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
GCLK [3 ：0]的
4
4
4
4
I / O组0
LB 0
LB 1
LB 2
LB 3
簇
内存
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
GCLK [3 ：0]的
4
4
4
4
I / O库1
LB 0
LB 1
LB 2
LB 3
簇
内存
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
LB 0
LB 1
LB 7
LB 6
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
LB 2
LB 3
簇
内存
PIM
LB 5
LB 4
簇
内存
通道
内存
I / O组2
I / O组3
图1. Delta39K100框图（三排×四列）与I / O组结构
概述
该Delta39K家族，是根据一个0.18毫米， 6层金属
CMOS逻辑制程，提供广泛的高密度
解决方案无与伦比的系统性能。该Delta39K
系列设计的高速结合，可预测的
定时和易于使用的CPLD的与高密度和
FPGA的低功耗。随着设备的范围从30000
200000可用门，该系列拥有设备的十倍
以前可用的CPLD的大小。即使在这些大
密度的Delta39K家庭足够快实施
完全可合成的64位， 66 - MHz的PCI核心。
文件编号： 38-03039牧师* H
该结构是基于逻辑块簇（ LBC ），该
通过水平和垂直（H和V ）的路由连接
通道。每个LBC有八个单独的逻辑块
（LB ）和两个簇存储器块。相邻LBC是
一个信道内存块，它可以直接从被访问
在I / O引脚。这两种类型的存储器块的高度config-
urable ，并且可以在宽度和深度上进行级联。看
图1
为Delta39K架构的框图。
在Delta39K家族的所有成员都赛普拉斯的高度
把系统内可再编程（ ISR ）功能，该功能
简化了设计和制造流动，从而
降低了成本。在ISR功能提供去重建的能力
第86 3
I / O块4
I / O块5
