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英特尔
奔腾
处理器基于0.13微米工艺高达1.33 GHz的
表16.有效的系统总线核心频率比
1, 2, 3
处理器
1A
1.13A
1.20
1.33
核心频率
（千兆赫）
1.00
1.13
1.20
1.33
BCLK频率
（兆赫）
133
133
133
133
频率
倍增器
7.5
8.5
9
10
注意事项：
1.请联系您当地的英特尔代表的处理器频率和/或频率的最新信息
乘法器。
2.虽然其他总线的比率被定义，不支持的操作在频率未列出的
英特尔
奔腾
III处理器基于0.13微米制程。
3.个人处理器将仅在其指定的系统总线频率下运行; 133兆赫。
表17.系统总线时序规范（ AGTL信号集团）
1, 2, 3
T＃参数
T7 ： AGTL输出有效延迟
T8 ： AGTL输入建立时间
T9 ： AGTL输入保持时间
T10 ： RESET ＃脉冲宽度
民
0.40
0.95
1.00
1.00
最大
3.25
单位
ns
ns
ns
ms
科幻gure
11
12
12
13
4
5, 6, 7, 10
8
6, 9
笔记
注意事项：
1.除非另有说明，本表中的所有规格适用于英特尔
奔腾
基于0.13 III处理器
微米制程，在所有频率。
2.这些规范在生产过程中进行测试。
3.所有的时序为AGTL信号都参考BCLK的上升缘和BCLK ＃在下降沿
处理器引脚。所有AGTL信号时序（兼容信号等）在0.80 V被引用在
处理器针脚。
4.有效延迟定时，这些信号被指定为50
至1.25 V ，V
REF
为0.8V ±2％和56
or
68
片上
TT
.
5，一种至少3个时钟必须的TRDY ＃ 2活性 - 无效跃迁之间得到保证。
6.复位＃可以断言（活性）以异步方式，但必须同步失效。
7.规范是从V最低0.40 V挥杆
REF
- 200 mV至V
REF
+ 200毫伏。这是假定边缘
率0.3 V / ns的。
8.规范是从V最高0.8 V摆幅
TT
- 0.8 V到V
TT
。这里假设为3 V / ns的边沿速率。
9.本应V后，再测量
CC
CORE
, V
TT
， Vcc的
CMOS
和BCLK （和BCLK ＃ ）是稳定的。
10.BREQ信号，观察1.2 ns最小建立时间。
表18.系统总线时序规范（ CMOS信号集团）
1, 2, 3, 4
T＃参数
T14 ： CMOS输入脉冲宽度，除了
PWRGOOD
T15 ： PWRGOOD无效脉冲宽度
民
2
10
最大
单位
BCLKs
BCLKs
科幻gure
11
15
笔记
主动和
无效状态
5
注意事项：
1.除非另有说明，本表中的所有规格适用于英特尔
奔腾
基于0.13 III处理器
微米制程，在所有频率
2.这些规范在生产过程中进行测试。
3.这些信号可被异步驱动。
4.所有CMOS输出应被确认至少有2个系统总线时钟。
5.当驱动为无效或V后
CC
CORE
, V
TT
, V
CCCMOS
和BCLK和BCLK ＃是稳定的。
数据表
33
