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介绍
表2-2 。 ZZG包终端分配
ZZG
球
号
A1
A7
A15
A21
B4
B8
B13
信号
SDRAM.A[3]
DV
DD4
CV
DD
V
SS
SDRAM.CAS
SDRAM.A[10]
CV
DD3
LCD.P[11](0)/
Z_STATE
(1)/
GPIO32(7)
LCD.P[1](0)/
Z_STATE
(1)
SDRAM.D[6]
SDRAM.DQML
SDRAM.D[15]
LCD.P[14](0)/
Z_STATE
(1)/
GPIO35(7)
LCD.HS(0)/
Z_STATE
(1)
SDRAM.DQSL
SDRAM.D[7]
SDRAM.D[14]
LCD.P[9](0)/
Z_STATE
(1)/
GPIO30(7)
KB.C[1](0)/
MPUIO6(1)
FLASH.A[4](0)
KB.R[3](0)/
MPUIO13(1)
ZZG
球
号
A2
A9
A17
B1
B5
B9
B14
信号
SDRAM.A[0]
CV
DD2
LCD.P[13](0)/
Z_STATE
(1)/
GPIO34(7)
V
SS
V
SS
SDRAM.A[5]
DV
DD4
ZZG
球
号
A3
A11
A19
B2
B6
B10
B15
信号
CV
DD2
CV
DDDLL
DV
DD1
SDRAM.A[1]
SDRAM.A[2]
DV
DD4
LCD.AC(0)/
SYS_CLK_OUT(1)/
Z_STATE
(2)
LCD.P[6](0)/
Z_STATE
(1)
DV
DD5
SDRAM.D[1]
SDRAM.D[8]
SDRAM.DQSH
LCD.P[7](0)/
Z_STATE
(1)
FLASH.A[5](0)
SDRAM.D[0]
SDRAM.DQMU
SDRAM.D[9]
ZZG
球
号
A5
A13
A20
B3
B7
B12
B16
信号
DV
DD4
V
SS
LCD.P[5](0)/
Z_STATE
(1)
SDRAM.BA[0]
V
SS
SDRAM.A[9]
V
SS
B17
B18
LCD.VS(0)/
Z_STATE
(1)
FLASH.A[3](0)
SDRAM.D[2]
SDRAM.CLK
SDRAM.D[11]
LCD.P[10](0)/
Z_STATE
(1)/
GPIO31(7)
KB.C[4](0)/
GPIO27(7)
SDRAM.D[4]
SDRAM.CLKX
SDRAM.D[13]
LCD.P[8](0)/
Z_STATE
(1)/
GPIO29(7)
FLASH.A[25]
NC
DV
DD1
B19
B20
CV
DD3
B21
C4
C8
C12
C1
C5
C9
C13
C2
C6
C10
C14
C3
C7
C11
C15
SDRAM.BA[1]
SDRAM.D[5]
SDRAM.D[12]
LCD.PCLK(0)/
Z_STATE
(1)
LCD.P[2](0)/
Z_STATE
(1)
FLASH.A[2](0)
SDRAM.D[3]
SDRAM.D[10]
LCD.P[15](0)/
Z_STATE
(1)/
GPIO2(7)
KB.C[2](0)/
GPIO61(7)
FLASH.A[7](0)
KB.R[4](0)/
MPUIO15(1)
FLASH.A[9](0)
C16
C17
C18
C19
C20
D4
D8
D12
C21
D5
D9
D13
D2
D6
D10
D14
D3
D7
D11
D15
D16
D17
D18
LCD.P[0](0)/
Z_STATE
(1)
CV
DD2
KB.C[3](0)/
GPIO63(6)
FLASH.A[20]
D19
D20
E4
E20
E1
E5
E21
E2
E18
F2
E3
E19
F3
Z_STATE =高阻
“NC ”表示“无连接” 。
§
LOW_STATE = 0
信号必须连接到低电平。
注： 1，阴影表示与复用功能的信号。
2.在信号名称的末尾括号内的数字表示管脚复用设置（见MUX CTRL设置列
表2-3和表2-4） 。
32
SPRS231D
2003年12月 - 修订2005年3月
