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的Stratix II体系结构
表2-4 。 M- RAM行接口单元信号
单元接口模块
L0
L1
L2
输入信号
datain_a[14..0]
byteena_a[1..0]
datain_a[29..15]
byteena_a[3..2]
datain_a[35..30]
addressa[4..0]
addr_ena_a
clock_a
clocken_a
renwe_a
aclr_a
addressa[15..5]
datain_a[41..36]
datain_a[56..42]
byteena_a[5..4]
datain_a[71..57]
byteena_a[7..6]
datain_b[14..0]
byteena_b[1..0]
datain_b[29..15]
byteena_b[3..2]
datain_b[35..30]
addressb[4..0]
addr_ena_b
clock_b
clocken_b
renwe_b
aclr_b
addressb[15..5]
datain_b[41..36]
datain_b[56..42]
byteena_b[5..4]
datain_b[71..57]
byteena_b[7..6]
输出信号
dataout_a[11..0]
dataout_a[23..12]
dataout_a[35..24]
L3
L4
L5
R0
R1
R2
dataout_a[47..36]
dataout_a[59..48]
dataout_a[71..60]
dataout_b[11..0]
dataout_b[23..12]
dataout_b[35..24]
R3
R4
R5
dataout_b[47..36]
dataout_b[59..48]
dataout_b[71..60]
f
见
的TriMatrix嵌入式存储器模块中的Stratix II &的Stratix II GX
器件
在量2章
的Stratix II器件手册
或
的Stratix II GX器件手册
有关的TriMatrix更多信息
内存。
Altera公司。
2007年5月
2–39
的Stratix II器件手册，卷1
