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的Stratix II体系结构
C16柱互连跨越16个LAB的长度，并提供了
最快的资源实验室之间的TriMatrix长柱连接
存储器模块， DSP模块和IOEs 。 C16互连可以跨越
M- RAM块，还开车到行和列互连在每
第四LAB 。 C16互连通过C4驱动LAB局部互连和
R4互连，并不直接驱动LAB局部互连。
所有嵌入块类似于LAB-逻辑阵列通信
到-LAB接口。每块（即， TriMatrix存储器和DSP块）
连接到行和列互连和具有本地互连
由行和列互连驱动区域。这些模块也有
直接链路互连用于向和从一个相邻的快速连接
LAB 。所有块由行LAB时钟馈送
labclk[5..0].
表2-2
显示了Stratix II器件的布线方案。
表2-2 。的Stratix II器件路由方案（第2第1部分）
目的地
共享算术链
直接链接互联
本地互连
M512 RAM块
R24互连
C16互连
M4K RAM块
R4互联
C4互连
寄存器链
M- RAM块
进位链
列IOE
DSP模块
共享算术链
进位链
寄存器链
本地互连
直接链接互联
R4互联
R24互连
C4互连
C16互连
ALM
M512 RAM块
M4K RAM块
M- RAM块
DSP模块
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Altera公司。
2007年5月
2–27
的Stratix II器件手册，卷1
ALM
来源
行IOE
