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数据表
引脚配置和功能描述
SCLK
1
DIN
2
16
AD7904/AD7914/AD7924
AGND
V
DRIVE
DOUT
AGND
V
IN
0
V
IN
1
03087-003
CS
3
AGND
4
AV
DD 5
AV
DD 6
REF
在7
AGND
8
AD7904/
AD7914/
AD7924
顶视图
（不按比例）
15
14
13
12
11
10
9
V
IN
2
V
IN
3
图3.引脚配置
表6.引脚功能描述
PIN号
1
2
3
4, 8, 13, 16
5, 6
7
9, 10, 11,
12
助记符
SCLK
DIN
CS
AGND
AV
DD
REF
IN
V
IN
3, V
IN
2,
V
IN
1, V
IN
0
功能
串行时钟，逻辑输入。 SCLK提供了用于从部分存取数据的串行时钟。此时钟输入也
作为时钟源AD7904 / AD7914 / AD7924转换过程。
数据输入，逻辑输入。数据被写入到AD7904 / AD7914 / AD7924的控制寄存器被设置在
这种输入和移入（参见控制寄存器部分）在SCLK的下降沿寄存器。
片选。低电平有效逻辑输入。该输入可对启动数据转换的双重功能
AD7904 / AD7914 / AD7924和帧的串行数据传输。
模拟地。接地参考点，在AD7904 / AD7914 / AD7924的所有模拟电路。所有模拟
输入信号和外部基准信号，应参考此AGND电压。所有AGND引脚应
连接在一起。
模拟电源输入。该AV
DD
范围为AD7904 / AD7914 / AD7924的2.7 V至5.25 V为0 V
至2× REF
IN
范围， AV
DD
应该是从4.75 V至5.25 V
参考输入的AD7904 / AD7914 / AD7924 。外部基准必须施加到该输入端。该
电压范围的外部引用是针对特定的性能的2.5 V ±1％。
模拟输入0到模拟输入3.四个单端模拟输入通道复用成
片内采样和保持。模拟输入通道进行转换使用地址位ADD1被选择并
ADD0控制寄存器。地址位，与SEQ1和SEQ0位配合，让音序器
进行编程。输入范围为所有输入通道可以延长从0 V至REF
IN
或者从0 V至2 × REF
IN
通过控制寄存器中的RANGE位选择。任何未使用的输入通道应连接到AGND
为了避免噪声干扰。
数据输出，逻辑输出。从AD7904 / AD7914 / AD7924的转换结果被设置在作为该输出
串行数据流。该位同步输出输入SCLK的下降沿。从该数据流
AD7904包含两个前导零，两个地址位，表示该通道的转换结果
对应，其次是8比特的转换数据，随后4个连续的零，首先提供的MSB 。
来自AD7914的数据流包括两个前导零，两个地址位指示哪个信道的
转换结果对应，其次是10比特的转换数据，后面两个尾随零，
首先提供MSB 。来自AD7924的数据流包括两个前导零，两个地址位表示
该信道的转换结果对应，其次是12位的转换的数据，提供最高位
第一。输出的编码可以被选作标准二进制或二进制补码，通过在编码比特补
控制寄存器。
逻辑电源输入。在此引脚的电源电压决定的电压在该串行接口
在AD7904的/ AD7914 / AD7924工作。
14
DOUT
15
V
DRIVE
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