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ADAU1442/ADAU1445/ADAU1446
S / PDIF接收器和发射器
该ADAU1442 / ADAU1445 / ADAU1446各设有一组
片上的S / PDIF的数据端口，可直接连接到
发射器和接收器方便地实现与其他S / PDIF-
兼容的设备。
S / PDIF给我
2
S输出部和将S / PDIF发射器 -
ON / OFF开关寄存器（地址0xE0C1 ）部分。
输出的多功能引脚
有可能从接收器直接发送的S / PDIF的数据到
输出MP上的引脚。这种模式是注册0xE241激活
（参见启用的S / PDIF到我
2
S输出部分） 。引脚
的信号分配示于表53 。
表53. S / PDIF到MP引脚分配
针
1
MP4
MP5
MP6
MP7
MP8
MP9
MP10
MP11
1
S / PDIF接收器
的S / PDIF输入端口设计为接收TTL和
双极性信号，只要对一个交流耦合电容
芯片的输入引脚。因为S / PDIF输入的数据将
最有可能是异步的DSP内核，它必须被路由
通过ASRC 。
在S / PDIF端口， 32 kHz的采样速率工作
和108千赫。
除了音频数据时， S / PDIF流包含用户数据，
通道状态，有效位，虚拟LRCLK和块开始
信息。接收器解码音频数据，并将其发送到
该ASRCs和DSP内核，但其余的数据通过
直接给发送器。这确保了任何用户数据是
未改变的输出，并重新集成到音频流。
在ADAU1442 / ADAU1445 / ADAU1446 ，时钟恢复
完全数字化。作为一个结果， ADAU1442 / ADAU1445 /
ADAU1446具有抗时钟抖动更好的保护。
该ADAU1442 / ADAU1445 / ADAU1446 S / PDIF端口
设计符合以下AES和EBU规格：一
0.25 UI PP抖动为8 kHz以上， 10页UI抖动
在200Hz以下，和200 mV的最小信号电压。
发送数据时， S / PDIF输出，必须打开。这是
通过写一个激活位到S / PDIF发射完成
开/关的寄存器。更多信息可以在启用发现
组
2
2
2
2
2
1
1
1
信号
有效位
用户数据
通道选择
块开始
虚拟LRCLK
SDATA
BCLK
LRCLK
该MP0至MP3销不适用，可以正常使用。
有两组信号，其中每一个可被激活
且彼此独立停用。所有未使用的MP
引脚功能正常。
S / PDIF发射器
了S / PDIF发射器输出两个通道的声音数据
直接从DSP内核为核心的速度。它不保留
或输出编码在任何其他非音频信息
S / PDIF输入流。在编码的非音频数据位
S / PDIF流是低的，除了有效位，这是很高的。
一些S / PDIF接收器将忽略所传输的音频数据
因为高有效位表示错误。
MP销
BCLK
I
2
S
变流器
LRCLK
5
SDATA
数据位
主
模式
音频
和
数据
SPDIFI
S / PDIF
接收器
音频
ASRCs
SPDIFO
DSP核心
S / PDIF
发射机
07696-054
图53. S / PDIF接收器和发射器
版本C | 65页92
