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ADSP-21161N
DMA握手
这些规范描述了三个DMA握手模式。
在所有三种模式DMAR用于发起传输。对于手工
防抖模式， DMAG控制闭锁或启用数据
外部。对于外部信号交换方式，数据传送是
由ADDR23-0 ， RD ， WR ， MS3-0 ，ACK和控制
表25. DMA握手
100兆赫
参数
民
最大
时序要求
t
国家发改委
DMARx设置CLKIN前
1
3.5
t
WDR
DMARx宽度低
t
CCLK
+4.5
2
（非同步）
t
SDATDGL
数据设置DMAGx后低
3
t
CKOP
– 0.5t
CCLK
–7
t
HDATIDG
数据保持DMAGx后高
2
t
DATDRH
数据有效DMARx后高
3
t
CKOP
+3
4
t
DMARLL
DMARx低边到边低
t
CKOP
2
t
DMARH
DMARx宽高
t
CCLK
+4.5
开关特性
t
DDGL
DMAGx低延迟CLKIN后
0.25t
CCLK
+1
0.25t
CCLK
+9
t
WDGH
DMAGx高宽
0.5t
CCLK
- 1 + HI
t
WDGL
DMAGx低电平宽度
t
CKOP
– 0.5t
CCLK
– 1
t
HDGC
DMAGx高延迟CLKIN后
t
CKOP
– 0.25t
CCLK
+1.0 t
CKOP
– 0.25t
CCLK
+9
t
VDATDGH
数据有效DMAGx前高
5
t
CKOP
– 0.25t
CCLK
– 8
t
CKOP
– 0.25t
CCLK
+5
6
t
DATRDGH
数据禁用DMAGx后高
0.25t
CCLK
– 3
0.25t
CCLK
+4
WRX低DMAGx前低
–1.5
+2
t
DGWRL
t
DGWRH
DMAGx低WRX前高
t
CKOP
– 0.5t
CCLK
– 2 +W
7
t
DGWRR
WRX高DMAGx前高
–1.5
+2
t
DGRDL
RDX低DMAGx前低
–1.5
+2
t
DRDGH
RDX低DMAGx前高
t
CKOP
– 0.5t
CCLK
–2+W
t
DGRDR
RDX高DMAGx前高
7
–1.5
+2
DMAGx高到WRX ， RDX低
0.5t
CCLK
- 2 + HI
t
DGWR
t
DADGH
地址/选择有效到DMAGx高15
t
DDGHA
地址/选择保持DMAGx后
1
高
W = （在等待寄存器中指定的等待状态数）
t
CKOP
.
HI = T
CKOP
（如果数据总线空闲周期时，所指定的等待寄存器;否则HI = 0）。
1
2
DMAG信号。对于节奏的主控模式下，数据传输
通过ADDR23-0 ， RD ， WR ， MS3-0和ACK （不可控
DMAG ） 。对于节奏的主控模式下，存储器读总线Mas-
器，存储器写总线主控和同步被读/写
总线主时序规范ADDR23-0 ， RD ， WR ，
MS3-0 ， DATA47-16和ACK也适用。
110兆赫
民
3.5
t
CCLK
+4.5
t
CKOP
– 0.5t
CCLK
–7
2
t
CKOP
+3
t
CKOP
t
CCLK
+4.5
0.25t
CCLK
+1
0.5t
CCLK
- 1 + HI
t
CKOP
– 0.5t
CCLK
– 1
t
CKOP
– 0.25t
CCLK
+1.0
t
CKOP
– 0.25t
CCLK
– 8
0.25t
CCLK
– 3
–1.5
t
CKOP
– 0.5t
CCLK
– 2 +W
–1.5
–1.5
t
CKOP
– 0.5t
CCLK
–2+W
–1.5
0.5t
CCLK
- 2 + HI
13
1
0.25t
CCLK
+9
最大
单位
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t
CKOP
– 0.25t
CCLK
9 NS
t
CKOP
– 0.25t
CCLK
5纳秒
0.25t
CCLK
+4
ns
+2
ns
ns
+2
ns
+2
ns
ns
+2
ns
ns
ns
ns
只要求承认在当前周期。
使用DMARx / DMAGx握手最大吞吐量（ @ 110 MHz）的等于吨
WDR
+ t
DMARH
= (t
CCLK
+4.5) + (t
CCLK
+4.5 ）= 27纳秒（ 37兆赫） 。这个吞吐量限制适用
只有非同步访问模式。
3
t
SDATDGL
是数据准备所需如果DMARx不被使用来推迟一个写操作结束。否则，如果DMARx低保持关闭写入完成时，数据可以
驱动吨
DATDRH
DMARx后拉高。
4
用吨
DMARLL
如果DMARx转换的同步与CLKIN 。否则，使用吨
WDR
和T
DMARH
.
5
t
VDATDGH
是有效的，如果DMARx不被使用，以保持关闭的读出完成。如果DMARx用于延长读，则T
VDATDGH
= t
CKOP
– 0.25t
CCLK
- 8 + （N ×厚
CKOP
），其中
n等于该接入被延长额外的周期数。
6
SEE
例如系统保持时间计算上的第54页
对于给定的电容和DC负载保持时间计算。
7
此参数适用于只同步访问模式。
版本C |
第40页60 |
2013年1月
