CDCE913
CDCEL913
SCAS849E - 2007年6月 - 修订2010年3月
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设备特点
在推荐工作的自由空气的温度范围（除非另有说明）
参数
整体参数
I
DD
电源电流（见
图3）
所有输出关闭，女
CLK
= 27 MHz时，
f
VCO
= 135 MHz的;
f
OUT
= 27 MHz的
无负载，所有的输出上，
f
OUT
= 27 MHz的
f
IN
= 0兆赫，
在所有的PLL
每个PLL
V
DDOUT
= 3.3 V
V
DDOUT
= 1.8 V
V
DD
= 1.9 V
0.85
80
V
DDOUT
= 3.3 V
V
DDOUT
= 1.8 V
V
DD
= 1.7 V ;我
I
= -18毫安
V
I
= 0 V或V
DD
; V
DD
= 1.9 V
V
I
= V
DD
; V
DD
= 1.9 V
V
I
= 0 V; V
DD
= 1.9 V
V
ICLK
= 0 V或V
DD
V
IXout
= 0 V或V
DD
V
IS
= 0 V或V
DD
V
DDOUT
= 3 V，I
OH
= -0.1毫安
V
OH
LVCMOS高电平输出电压
V
DDOUT
= 3 V，I
OH
= -8毫安
V
DDOUT
= 3 V，I
OH
= -12毫安
V
DDOUT
= 3 V，I
OL
- 0.1毫安
V
OL
t
PLH
, t
PHL
t
r
/t
f
t
JIT （ CC ）
t
JIT （ PER ）
t
SK （ O）
ODC
LVCMOS低电平输出电压
V
DDOUT
= 3 V，I
OL
= 8毫安
V
DDOUT
= 3 V，I
OL
= 12毫安
传播延迟
上升和下降时间
周期到周期抖动
(2)
(4)
(3)
(3)
测试条件
民
典型值
(1)
最大
单位
11
9
1.3
0.7
30
1.45
230
230
230
mA
I
DD （ OUT ）
I
DD （ PD ）
V
（ PUC ）
f
VCO
f
OUT
电源电流（见
图4
和
图5）
掉电电流。每个回路供电
除下来SDA / SCL
电源电压V
dd
阈值电
控制电路
PLL的VCO频率范围
LVCMOS输出频率
mA
mA
V
兆赫
兆赫
LVCMOS参数
V
IK
I
I
I
IH
I
IL
C
I
LVCMOS输入电压
LVCMOS输入电流
LVCMOS输入电流为S0 / S1 / S2
LVCMOS输入电流为S0 / S1 / S2
输入电容鑫/ Clk时
输入电容XOUT
输入电容在S0 / S1 / S2
–1.2
±5
5
–4
6
2
3
pF
V
mA
mA
mA
CDCE913 - LVCMOS参数FOR V
DDOUT
= 3.3 V - 模式
2.9
2.4
2.2
0.1
0.5
0.8
3.2
0.6
50
60
70
100
60
45%
55%
ns
ns
ps
ps
ps
V
V
PLL旁路
V
DDOUT
= 3.3 V (20%–80%)
1锁相环开关，Y2到Y3
1锁相环开关，Y2到Y3
f
OUT
= 50 MHz的; Y 1至Y 3
f
VCO
= 100 MHz的; PDIV = 1
V
DDOUT
= 2.3 V，I
OH
= -0.1毫安
峰 - 峰值周期抖动
输出偏斜
(5)
见
表2
输出占空比
CDCE913 - LVCMOS参数V
DDOUT
= 2.5 V - 模式
2.2
1.7
1.6
0.1
0.5
0.7
3.6
0.8
50
60
70
100
60
45%
55%
ns
ns
ps
ps
ps
V
V
V
OH
LVCMOS高电平输出电压
V
DDOUT
= 2.3 V，I
OH
= -6毫安
V
DDOUT
= 2.3 V，I
OH
= -10毫安
V
DDOUT
= 2.3 V，I
OL
- 0.1毫安
V
OL
t
PLH
, t
PHL
t
r
/t
f
t
JIT （ CC ）
t
JIT （ PER ）
t
SK （ O）
ODC
LVCMOS低电平输出电压
V
DDOUT
= 2.3 V，I
OL
= 6毫安
V
DDOUT
= 2.3 V，I
OL
= 10毫安
传播延迟
上升和下降时间
周期到周期抖动
(2)
(4)
(3)
(3)
PLL旁路
V
DDOUT
= 2.5 V (20%–80%)
1锁相环开关，Y2到Y3
1锁相环开关，Y2到Y3
f
OUT
= 50 MHz的; Y 1至Y 3
f
VCO
= 100 MHz的; PDIV = 1
峰 - 峰值周期抖动
输出偏斜
(5)
见
表2
输出占空比
(1)
(2)
(3)
(4)
(5)
6
所有典型值均在各自的标称V
DD
.
10000次。
抖动取决于配置。抖动的数据是输入频率= 27MHz的，女
VCO
= 108兆赫，女
OUT
= 27兆赫（在Y 2测量）。
该TSK （O ）规范仅适用于输出每家银行的同等负荷，并从相同的分频器所产生的输出。
ODC取决于输出的上升和下降时间（t
r
/t
f
） ;采样上升沿（ TR ）数据
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