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ADSP-21060/ADSP-21060L/ADSP-21062/ADSP-21062L/ADSP-21060C/ADSP-21060LC
引脚功能描述
在ADSP- 2106x引脚定义如下表所示。输入identi-
田间的同步（ S）必须满足时序要求，与
相对于CLKIN （或相对于TCK为TMS，TDI ） 。
确定异步（A ）输入可以断言asynchro-
nously到CLKIN （或TCK的TRST ） 。
未使用的输入应连接或上拉至VDD和GND ，除
对于ADDR31-0 ， DATA47-0 ， FLAG3-0 ，并具有输入
内部上拉或下拉电阻（CPA ， ACK ，DTX DRx的，
TCLKX ， RCLKx ， LxDAT3-0 ， LxCLK ， LxACK ， TMS和
TDI ） - 这些引脚可以悬空。这些引脚有
防止从浮置输入端的逻辑电平保持电路
在内部。
表3.引脚说明
功能
外部总线地址。
外部存储器和外围设备，这些在ADSP- 2106x输出地址
销。在一个多处理器系统中，对内部存储器的读/写总线主机输出地址
或IOP寄存器的其他ADSP- 2106xs 。在ADSP- 2106x输入地址时，主机处理器或多
处理总线主机读取或写入其内部存储器或IOP寄存器。
DATA47–0
I / O / T
外部总线数据。
这两个引脚上ADSP- 2106x输入和输出数据和指令。 32位的单
精度浮点数据和32位定点数据被传过比特总线47-16 。 40位
扩展精度浮点数据被传过比特总线47-8 。 16位短字数据
转出位的总线31-16 。 PROM中的引导模式中， 8位数据被传送过的比特23-16 。拉
关于未使用的DATA管脚电阻是没有必要的。
O / T
内存选择线路。
这些线有效（低）作为片选对外部相应的银行
MS3–0
内存。存储体的大小必须在ADSP- 2106x的系统控制寄存器（ SYSCON ）来定义。该
MS3-0线解码该改变的同时与其他地址线存储器地址线。
当没有外部存储器访问发生时， MS3-0线无效;他们是活跃但是当
有条件的存储器访问指令被执行时，条件是否为真。 MS0可以使用
用PAGE信号来实现的DRAM内存银行（ Bank 0中） 。在多处理系统中的MS3-0
线是由总线主机输出。
RD
I / O / T
存储器读选通。
该引脚置位（低电平）时， ADSP- 2106x外部存储设备读取
或从其他的ADSP- 2106xs内部存储器。外部设备（包括其他ADSP - 2106xs ）绝
断言RD从ADSP- 2106x的内部存储器读取。在多处理系统中， R D是输出由
总线主控器，是所有其他ADSP - 2106xs输入。
I / O / T
存储器写选通。
该引脚置位（低电平）时， ADSP- 2106x写入外部存储器
WR
或以其他ADSP- 2106xs内部存储器。外部设备必须断言WR写入到ADSP-
2106x的内部存储器。在一个多处理器系统中， WR输出总线主机并输入所有
其他ADSP- 2106xs 。
页面
O / T
DRAM页边界。
在ADSP- 2106x声称该引脚信号，一个外部DRAM页边界
已经越过。 DRAM的页大小必须在ADSP- 2106x的存储器控制寄存器（ WAIT）来定义。
DRAM只能在外部存储器银行0来实现;的PAGE信号只能用于银行被激活
0访问。在一个多处理器系统中，页面由总线主机输出
ADRCLK
O / T
时钟输出参考。
在一个多处理器系统， ADRCLK是由总线主输出。
SW
I / O / T
同步写选择。
这个信号被用于连接在ADSP- 2106x至同步存储器器件
（包括其它的ADSP- 2106xs ） 。在ADSP- 2106x断言SW （低）提供的一个早期迹象
即将到来的写周期，这可以被中止，如果WR是不是以后断言（例如，在有条件的写
指令）。在一个多处理器系统， SW输出总线主机并输入所有其他
ADSP- 2106xs ，以确定该多处理器存储器访问是读或写操作。 SW被断言在同一
时间作为地址输出。使用同步写入到写的时候必须断言该引脚上的主处理器
在ADSP- 2106x （ S） 。
A =异步，G =地面， I =输入， O =输出， P =电源，S =同步， （ A / D） =有源驱动， （O / D） =漏极开路，
T =三态（当SBTS被认定时，或当在ADSP- 2106x是一个总线从设备）
针
ADDR31–0
TYPE
I / O / T
牧师F
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2008年3月
