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THS8200-EP
SLES253 - 2009年12月
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4.7.2
功能说明
用户应编程DTG与当前的视频格式的正确参数。在DTG
包含线和像素计数器，和一个状态机，以确定哪些用户定义的线的波形，以
输出上的模拟输出的每一行。像素计数器计数水平方向放大的总数
每行的像素，在' dtg1_total_pixels '编程。行计数器计数到“ dtg1_field_size ”线
第一个字段，并继续向上计数的总框架（字段1 +场2 ）在“ dtg1_frame_size '行。
当前场被从偶数/奇数场识别信号，它的采样是垂直同步的开始衍生
期。源为内部的FID信号可以是信号，以FID的终端，也可以是
内部来源于相对水平同步/垂直同步定位在相应的终端，如选择
' dtg2_fid_de_cntl '和当前的DTG模式（VESA与SDTV / HDTV ） 。见寄存器的地图
“ dtg2_fid_de_cntl ”的更多细节。来自水平同步/垂直同步输入校准FID的推导是根据完成
到EIA- 861规范。上有水平同步/垂直同步转型实现错位公差。
当垂直同步过渡的有效边沿在± 63时钟周期发生离的活性边缘
行同步，这两个信号被解释为对齐，这标志着由于这种定时窗口的字段1 ，在
内部FieldID信号迟于垂直同步周期的开始产生。由于信号在内部进行
采样的垂直同步周期来确定当前字段的起始，该字段的解释是相反。
使用“ field_flip ”注册通过实地逆转纠正。
如果视频格式是渐进的，只有field1的存在和没有的FID信号是必要的。然而， DTG将
仅当检测到字段1的条件，即当FID检测到低处的垂直同步开始启动
期。因此，在逐行扫描的视频格式的情况下，以及使用具有外部FID的输入设备时，
用户必须确保保持FID终端低。
它也需要进行适当的DTG同步的编程水平同步和垂直同步输入极性
是正确的。由于水平同步，垂直同步极性改变不同VESA PC格式，该设备还内置了
支持检测所述传入同步的极性。这是通过比较Hsync的高的宽度做
（' misc_ppl '）的总线路长度（' dtg2_pixel_cnt '）来导出的Hsync的占空比，因此，其极性。
在此检测中，用户可以检测到传入的极性为DTG输入的同步方案
（ “ dtg2_hs_pol ” ） - 这是不是由设备自动进行设置。该过程是类似的垂直同步极性
检测，通过寄存器' misc_lpf '，' dtg2_line_cnt '和' dtg2_vs_pol ' 。
在DTG的同步可以被分成三个功能：
内部同步：
如何DTG相对于同步的内部的水平和
垂直计数器。
源同步：
如何在水平和垂直计数器同步到
HS_IN / VS_IN / FID或SAV / EAV信号。
输出同步：
如何输出定时HS_OUT ， VS_OUT和复合同步输出
同步到DTG和在水平和垂直计数器。
在DTG是基于状态机，能够生成一组线类型，可以覆盖值上
在DAC的输入。在DTG的输出复用成由DIGMUX的数据路径。所选择的视频
格式预设的设置，或在一个通用的方式被选择的编程（线型，断点）表
在dtg1_mode ，确定哪些线类型为特定线路产生的，并且其中该DTG输出是
用来覆盖正常的DAC输入。在内部，从存在线型固定预配置数量
用户可从中进行选择。
此外，对于每个集线类型（我们将看到下一个有两个不同组的行类型的可能的话） ，用户
可以设定每个预定义的漂移水平的持续时间（负同步，积极同步，回
门廊，门廊，宽脉冲，隔行扫描同步，等等），并且还对振幅（例如，负的同步
振幅，正同步幅度，空白振幅）。
dtg1_mode的设置决定：
内部同步：
该0H引用（水平的DTG复位）是SDTV之间的不同
和HDTV 。
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详细功能描述
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