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时钟CON组fi guration模式
表17.时钟配置为PCI主机模式（ PCI_MODCK = 0 ）
1,2
（续）
模式
3
MODCK_H-
MODCK[1-3]
1011_100
1011_101
总线时钟
（兆赫）
低
高
CPM时钟
（兆赫）
低
高
CPU时钟
（兆赫）
低
高
PCI时钟
（兆赫）
低
50.0
50.0
高
66.7
66.7
CPM
乘法
因素
4
中央处理器
乘法
因素
5
PCI
区划
因素
6
80.0 106.7
80.0 106.7
2.5
2.5
200.0 266.6
200.0 266.6
4
4.5
320.0 426.6
360.0 480.0
4
4
1101_000
1101_001
1101_010
1101_011
1101_100
100.0 133.3
100.0 133.3
100.0 133.3
100.0 133.3
100.0 133.3
2.5
2.5
2.5
2.5
2.5
250.0 333.3
250.0 333.3
250.0 333.3
250.0 333.3
250.0 333.3
3
3.5
4
4.5
5
300.0 400.0
350.0 466.6
400.0 533.3
450.0 599.9
500.0 666.6
5
5
5
5
5
50.0
50.0
50.0
50.0
50.0
66.7
66.7
66.7
66.7
66.7
1101_101
1101_110
125.0 166.7
125.0 166.7
2
2
250.0 333.3
250.0 333.3
3
4
375.0 500.0
500.0 666.6
5
5
50.0
50.0
66.7
66.7
1110_000
1110_001
1110_010
1110_011
1110_100
100.0 133.3
100.0 133.3
100.0 133.3
100.0 133.3
100.0 133.3
3
3
3
3
3
300.0 400.0
300.0 400.0
300.0 400.0
300.0 400.0
300.0 400.0
3.5
4
4.5
5
5.5
350.0 466.6
400.0 533.3
450.0 599.9
500.0 666.6
550.0 733.3
6
6
6
6
6
50.0
50.0
50.0
50.0
50.0
66.7
66.7
66.7
66.7
66.7
1100_000
1100_001
1100_010
1
版权所有
版权所有
版权所有
2
3
4
5
6
的“低”值是允许的最低频率为给定的时钟模式。在最小的总线频率
表条目，保证只有所需要的最小CPU操作频率。的“高”值是为目的
插图而已。用户必须选择一个模式，并输入总线频率，使得所得到的结构不超过
用户装置的频率等级。最小CPU频率为150 MHz的商用温度
设备和175 MHz的宽温度的设备。最低每千次展示频率为120兆赫。
PCI_MODCK确定PCI时钟的频率范围。请参阅表
18
较低的范围内配置。
MODCK_H =硬复位配置字[ 28-31 ] （参见SoC的参考手册第5.4节） 。 MODCK [1-3] =
三种硬件配置引脚。
CPM倍增因数= CPM时钟/总线时钟
CPU倍频系数=核心PLL倍频因子
CPM_CLK / PCI_CLK比例。当PCI_MODCK = 0， CPM_CLK / PCI_CLK的比率应当由下式计算
SCCR [ PCIDF ]如下：
CPM_CLK / PCI_CLK = （ PCIDF + 1 ）/ 2。
MPC8272的PowerQUICC II系列硬件规格，第3版
飞思卡尔半导体公司
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