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FLEX 6000可编程逻辑器件系列数据手册
级联链
级联链可以使FLEX 6000架构实现非常
宽的扇入的功能。相邻的LUT可以用于实现部分
在平行的功能;级联链串接的
中间值。级联链可以使用逻辑
和
或逻辑
OR
门（通过德·摩根的反转）来连接相邻的输出
个LE 。每增加一个LE提供了四个输入有效宽度
的功能，具有延迟低至每LE的0.5纳秒。可以级联链逻辑
由Altera的软件设计处理过程中自动创建的，
或手动设计输入过程中的设计师。参数化功能
如LPM和DesignWare的功能自动乘虚而入
级联链的相应功能。
级联链实现的
和
门可以使用寄存器在上
LE ;级联链实现的
OR
门不能使用这个寄存器
由于来实现所需的反转
OR
门。
因为LAB的第一个LE可以产生控制信号为LAB ，
在每个LAB第一LE的，不包含在级联链。此外，
级联链的长度超过9比特由自动实施
连接几个实验室一起。为了更容易地路由，长级联链
跳过一排隔LAB 。级联链的长度超过一个LAB
跳过无论是从一个偶数LAB到另一个偶数编号的
LAB，或者从一个奇数LAB到另一个奇数LAB 。为
例如，在一个行级联到第二LE的所述第一LAB的最后一个LE
第三个LAB 。级联链不交叉的行的中心。为
例如，在一个EPF6016装置，所述级联链停止在第11 LAB
一排和一个新的级联链开始于第12个LAB 。
图6
显示了级联功能可以连接相邻的LE形成
函数具有宽扇形英寸在这个例子中， 4n个变量的函数是
与实施
n
个LE 。级联链需要3.4 ns至解码
16位的地址。
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Altera公司。
