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CYF2018V
CYF2036V
CYF2072V
引脚德网络nitions
引脚名称
D[35:0]
Q[35:0]
文
任
IE
I / O
输入
产量
输入
输入
输入
数据输入：数据输入一个36位的总线。
数据输出：输出数据为36位总线。
写使能：文WCLK能够将数据写入FIFO存储器和配置寄存器。
读使能： REN使RCLK读取FIFO存储器和配置寄存器中的数据。
输入使能： IE浏览器是数据输入使能控制的启用和禁用36位数据信号
输入引脚。如果被启用，在D数据[35 ：0]引脚被写入到FIFO。内部写地址
指针总是递增WCLK的上升沿，如果文被使能，而IE的水平。这
用于“写屏蔽”或递增写指针而无需编写成的位置。
输出使能：当OE是低电平时， FIFO数据输出使能;当OE为高电平，则FIFO的输出
在高Z（高阻）状态。
写时钟：当通过温启动， WCLK的上升沿将数据写入到FIFO中，如果LD为高和
进入配置寄存器，如果LD低。
读时钟：当由任使能， RCLK的上升沿从FIFO存储器中读取数据，如果LD是
高，从配置寄存器，如果LD低。
空标志：当EF为低，队列为空。 EF同步到RCLK 。
全旗：当FF为低电平时，队列已满。 FF同步到WCLK 。
负载：当LD为低时， D [7： 0]（ Q [ 7 ：0]）被写入（读出）到（从）中的配置寄存器。当
LD是高电平时， D [ 35 ：0]（ Q [ 35 ：0]）被写入（读出）到（从）的FIFO中。
重发： RT上的高脉冲复位内部读指针到FIFO中的物理位置而
（使用MARK引脚）的特点是用户。与重传后每一个有效的读周期，先前访问
数据被读出和读出指针被递增，直到它等于写指针。
主复位：刘健初始化读写指针为零，并设置输出寄存器为全零。
在主复位，配置寄存器都被设置为默认值和标志复位。
串行时钟：在SPI_SCLK的上升沿钟表上的SPI_SI输入串行数据到目前的偏移
如果SPI_SEN启用寄存器。
串行输入：当SPI_SEN启用串行输入。
串行enable：使能配置寄存器的串行加载。
马克的重发：当该引脚置读指针的当前位置标记。任何
随后的重传操作复位读指针到这个位置。
邮箱：置位的读取和写入操作发生在流通邮箱注册。
写队列中进行选择：选择使用引脚最多8个队列。
读取队列中进行选择：使用引脚选择最大8个队列。
测试时钟（ TCK ）引脚用于JTAG 。
复位引脚用于JTAG 。
测试模式选择（ TMS ）引脚用于JTAG 。
在（ TDI ）引脚用于JTAG测试数据。
测试数据输出（ TDO）的JTAG 。
数据有效：低有效数据有效信号以表示Q上的有效数据[35 ：0] 。
引脚说明
OE
WCLK
RCLK
EF
FF
LD
RT
输入
输入
输入
产量
产量
输入
输入
太太
SPI_SCLK
SPI_SI
SPI_SEN
标志
MB
WQSEL [2 ：0]的
RQSEL [2 ：0]的
TCK
TRST
TMS
TDI
TDO
DVAL
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
输入
产量
产量
文件编号： 001-68336修订版* C
第31 5
