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AD9637
工作原理
该
AD9637
是一个多级，流水线ADC 。每个阶段
提供足够的重叠，以校正在闪速错误
前级。各个级的量化输出是
组合成一个最终的12位的结果，在数字校正
逻辑。串行器发送这个转换后的数据在一个12位的
输出。流水线结构允许第一级到
用一个新的输入采样进行操作，而其余的阶段
操作与前面的样本。采样发生在上升
在时钟的边缘。
每个阶段的管道，但不包括最后一个，包括一个低
连接到一个开关电容器DAC分辨率快闪型ADC
和一个级间余量放大器（例如，乘法
数字 - 模拟转换器（MDAC ））。余量放大器
放大重构DAC输出之间的差
和闪光灯的输入，用于流水线的下一个阶段。一个位
冗余用在每一阶段以促进数字校正
闪光的错误。最后一级仅由一个Flash型ADC 。
输出级模块能够实现数据对齐，纠正错误，
在将数据传递到输出缓冲器。然后，数据被串行化
并对准到帧和数据时钟。
数据表
输入可以帮助减少注入的峰值瞬态电流
的驱动源的输出级。此外，低Q值电感
或铁氧体磁珠可被放置在输入的每个腿，以减少
高差分电容在模拟输入端，并因此
实现ADC的最大带宽。这种使用的低
Q电感或铁氧体磁珠驱动器时，需要
在高IF频率的前端。任一个差动电容器或
两个单端电容器可以放置在输入端，以提供
匹配的无源网络。这最终产生一个低通
滤波器的输入端，以限制不需要的宽带噪声。见
AN-742
应用笔记中，
AN-827
应用说明及
模拟对话
文章“变压器耦合
前端
宽带A / D转换器“
（第39卷， 2005年4月），了解更多
信息。在一般情况下，精确值依赖于
应用程序。
输入共模
的模拟输入
AD9637
无内部直流偏置。
因此，在交流耦合的应用程序时，用户必须提供
这种偏见在外部。设置该设备使V
CM
= AVDD / 2是
推荐的最佳性能，但该装置可
功能在更宽的范围内以合理的性能，如
在图44中所示。
100
90
80
SNR / SFDR （ dBFS的/ DBC）
模拟输入考虑
模拟输入到
AD9637
是差分，切换
电容电路设计用于处理差分输入
信号。该电路可支持宽共模范围
同时保持出色的性能。通过使用输入
中间电源的共模电压，用户可以最小化
信号有关的误差和性能达到最优化。
SFDR
SNRFS
70
60
50
40
30
20
0.5
H
C
PAR
VIN + X
S
S
H
C
样品
S
S
0.7
0.9
V
CM
(V)
1.1
1.3
C
样品
VIN- X
C
PAR
H
H
10215-042
图44. SNR / SFDR主场迎战共模电压，
f
IN
= 9.7兆赫，女
样品
= 80 MSPS
图43.开关电容输入电路
时钟信号交替地切换之间的输入电路
采样模式和保持模式（参见图43） 。当输入
电路切换到采样模式时，信号源必须是
可充电的电容器的样品和解决中
二分之一的一个时钟周期。一个小电阻串联各
一个板上，共模电压的参考被包括在
的设计和可从VCM引脚。 VCM引脚
必须脱钩由0.1 μF的电容到地，如描述
在应用信息部分。
最大SNR性能由ADC设置为实现
跨度最大差分配置中。中的情况下
AD9637,
最大输入范围可为2 V P-P 。
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