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ADS5263
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SLAS760B
–
2011年5月
–
经修订的2011年10月
注册
地址
A7–A0
十六进制
42
D15
0
D14
0
D13
0
D12
0
D11
0
D10
0
D9
0
注册资料
D8
0
D7
0
D6
D5
D4
0
D3
0
D2
0
D1
0
D0
0
<PHASE_DDR>
寄存器PHASE_DDR可以用来控制LCLK的相位（相对于的上升沿
帧时钟， ADCLK ） 。看
可编程LCLK相
了解详细信息。
A7–A0
十六进制
45
D15
0
D14
0
D13
0
D12
0
D11
0
D10
0
D9
0
D8
0
D7
0
D6
0
D5
0
D4
0
D3
0
D2
0
D1
<SYNC
PATTERN>
D0
<DESKEW
PATTERN>
D1
0
1
<SYNC
PATTERN>
同步模式被禁用
同步模式启用。
所有通道输出8 1和8 0 ，而不是ADC数据的重复模式。
输出数据[15 ... 0] =为0xFF00
D1
0
1
<DESKEW
PATTERN>
歪斜校正模式被禁用
歪斜校正模式启用。
所有通道输出1010101010101010 ，而不是ADC数据的重复模式。
版权
2011年，德州仪器
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产品文件夹链接（ S） ： ADS5263
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