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F28M35H20B1 ， F28M35H20C1
F28M35H22B1 ， F28M35H22C1 ， F28M35H32B1 ， F28M35H32C1
F28M35H50B1 ， F28M35H50C1 ， F28M35H52B1 ， F28M35H52C1
SPRS742D - 2011年6月 - 修订2012年8月
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6.3.7
C28x的多通道缓冲串行端口（ McBSP的）
该器件提供了缓冲串行端口（ McBSP的）一种高速多通道，允许直接接口
要编解码器和其他设备。 CPU访问的数据，控制和状态信息。 McBSP的还
支持μDMA传输。
McBSP的是由一个数据流的路径和由六个销连接到外部设备的控制路径。
数据被传递到通过数据发送（ DX）引脚接口与McBSP设备
传输，并通过所述数据接收（DR）的销接收。在时钟的形式控制信息
和帧同步是通过以下引脚连通： CLKX （发送时钟） ， CLKR （接收
时钟） ， FSX （发送帧同步） ，和FSR （接收帧同步） 。
通过访问的16位宽的寄存器与McBSP CPU和DMA控制器进行通信
通过内部外围总线。 CPU或DMA控制器写入要发送到所述数据
数据发送寄存器（ DXR1 ， DXR2 ） 。写入DXRs数据通过发送移位移出到DX
寄存器（ XSR1 ， XSR2 ） 。同样，接收DR引脚的数据移入接收移位寄存器
（ RSR1 ， RSR2 ），并复制到接收缓冲寄存器（ RBR1 ， RBR2 ） 。该RBRs的内容是
然后复制到的DRR ，其可以由CPU或DMA控制器读取。这种方法允许
内部和外部的数据通信的同时运动。
DRR2 ， RBR2 ， RSR2 ， DXR2和XSR2不使用（写入，读取，或移位）如果串行字长度是
8位，12位，或16位。对于较大的字长度，就需要这些寄存器来保存最显著
位。
环回帧和时钟在芯片级实现为使CLKX和FSX驱动CLKR和
FSR 。如果环回的被启用， CLKR和FSR得到的CLKX和FSX垫的信号
代替CLKR和FSR引脚。
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