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NCV7512
开放
负载
门槛
短
负载
门槛
DRNx
IN
X
50%
t
P(关闭)
GAT
X
t
P(上)
50%
80%
20%
t
R
t
F
图4.栅极驱动时序图 - 并行输入
CSB
50%
G
X
t
P(关闭)
GAT
X
t
P(上)
图5.栅极驱动时序图 - 串行输入
50%
DRN
X
IN
X
50%
t
BL (上)
FLTB
50%
t
BL (关闭)
50%
图6.消隐时序图
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