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TLV320AIC3104EVM软件
4.8.1.1
使用不带PLL
建立TLV320AIC3104用于计时，而无需使用PLL的允许最低的功率消耗
由编解码器。该
CLKDIV_IN
源可被选择为
MCLK ， GPIO2 ，
or
BCLK ，
默认值是
MCLK 。该CLKDIV_IN频率然后输入到
CLKDIV_IN
中，在兆赫（MHz ） 。该
显示默认值， 11.2896 MHz的，是对USB - MODEVM主板所使用的频率。这个值然后
由Q的值，它可以从2至17设定分;所产生的
CLKDIV_OUT
频率显示
在指示器旁
Q
控制权。该结果的频率被示为
实际Fsref 。
4.8.1.2
使用带有PLL
当PLLDIV_OUT被选择为编解码器的时钟源时，PLL将被使用。 PLL时钟源
使用所选择的
PLLCLK_IN
控制，并且可以被设置为
MCLK ， GPIO2 ，
or
BCLK 。
该PLLCLK_IN
频，然后输入到
PLLCLK_IN来源
框。
该
PLL_OUT
和
PLLDIV_OUT
指标显示所产生的PLL输出频率与设定值
为PLL中的P ，K和R参数。见
TLV320AIC3104
数据手册的说明
这些参数。该参数可以通过点击的向上/向下箭头来设置
P，K ，
和
R
组合框，或者可以将它们输入到这些框。
这些值也可以通过PC软件来计算。要使用PC软件，找到理想值
磷，钾，且R为一个给定的PLL输入频率和期望Fsref ：
1.确认正确的参考频率输入到
PLLCLK_IN来源
框在兆赫（MHz）
2.所需Fsref应该使用设置
Fsref
开关。
3.推
寻找理想的设置
按钮。该软件将开始寻找理想组合
磷，钾，和R，它实现所需Fsref 。将显示这些参数的可能设置
在类似电子表格的表中的标签
可能的设置。
4.单击某一行此表中选择位于该行的P，K和R值。请注意，当这是
完成时，软件更新为P ， K，R， PLL_OUT和PLLDIV_OUT读数，以及在
实际
Fsref
和错误显示。这些值显示了基于被选择的值的计算。
这一过程实际上并不然而加载值到TLV320AIC3104 ;它仅更新
在软件中显示。如果有一个以上的行存在，用户可以选择其他行以查看哪个
可能的设定最接近理想的设置。
当P ，K和R的合适的组合已被选定时，按
加载设置到设备？
按钮，会下载这些值插入TLV320AIC3104相应的寄存器。
4.8.1.3
设置ADC和DAC采样率
该Fsref频率是决定要么启用或绕过PLL （见
4.8.1.1节
or
第4.8.1.2 ）
用于确定实际的ADC和DAC的采样率。使用
NADC
和
NDAC
因子速率从Fsref得到的采样。如果双速率模式是理想的，此选项可以
被使能用于任一所述的ADC或DAC，通过按相应的
双速率模式
按钮。该ADC
和DAC的采样率显示在框中的每个控制权。
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TLV320AIC3104EVM和TLV320AIC3104EVM -PDK
SLAU218 - 2007年8月
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