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Fusion系列混合信号FPGA的
调整
提前V1.0
（ 2008年1月）
变化
所有的时序特性表进行了更新。对于差分I / O标准，
标准I / O支持表是新的。
表2-3 坐标数组
被更新，以改变它的最大的x和y的值
表2-12 融合CCC / PLL规格
已更新。
的说明加入
表2-16 · RTC ACM内存映射。
引用该外设的用户指南加到
"Voltage稳压器
电源监控器（ VRPSM ） "部分。
In
表2-25 闪存模块时序，
商业条件
更新。
In
表2-26 FlashROM的访问时间，
商业条件不翼而飞
并已添加下面的表的标题。
In
表2-36 模拟模块引脚说明，
功能说明已更新
为ADCRESET 。
在
"Voltage Monitor"部分，
下面这句话原本有± 10 ％ ，并
改变为±10％。
模拟四输入宽容高达12伏±10％。
此外，这种说法是从数据表中删除：
当接通电源（3毫安3 V ）每个I / O会消耗功率。
该
"Terminology"节
是新的。
该
"Current Monitor"节
已显著更新。
图2-72 时序
图中的电流监控器频闪
to
图2-74 负电流监控器
和
表2-37 对于不同的电流量程测量电阻推荐
是
新。
该
"ADC Description"节
进行了更新，添加了
"Terminology"部分。
在
"Gate Driver"部分，
25毫安变更为20 mA和1.5兆赫
改为1.3兆赫。此外，下面这句话被删除：
最大AG垫的开关频率为1.25MHz 。
该
"Temperature Monitor"节
进行了更新，重写大部分的文字，并添加
图2-78 ，图2-79 ，
和
表2-38 温度数据格式。
In
表2-38 温度数据格式，
温度K栏被更改
85 ℃，从538到358 。
In
表2-45 ADC接口时序，
"Typical - Case"变为"Worst - Case."
该
"ADC接口Timing"节
是新的。
表2-46 ·模拟信道规范
已更新。
该
＆ QUOT ; V
CC15A
模拟电源（ 1.5 V） "节
已更新。
该
＆ QUOT ; V
CCPLA / B
PLL供应Voltage"节
是新的。
In
＆ QUOT ; V
CCNVM
闪存模块电源（ 1.5 V） "部分，
供应量
改来提供输入。
该
＆ QUOT ; V
CCPLA / B
PLL供应Voltage"
引脚说明进行了更新，包括：
下面的语句：
Actel的建议搭售VCCPLX到VCC，采用适当的滤波电路
脱钩V
CC
从PLL噪声。
该
＆ QUOT ; V
COMPLA / B
地面西部和东部PLL"节
已更新。
页面
不适用
2-9
2-31
2-37
2-42
2-55
2-58
2-82
2-86
2-88
2-90
2-93
2-94
2-96
2-98
2-110
2-110
2-118
2-224
2-225
2-224
2-225
2-225
修订4
5 -9
