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TMS320DM643
SPRS269D - 2005年2月 - 修订2010年10月
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表2-4 。终端功能
信号
名字
CLKIN
CLKOUT4/GP0[1]
(3)
CLKOUT6/GP0[2]
(3)
CLKMODE1
CLKMODE0
PLLV
(4)
TMS
TDO
TDI
TCK
TRST
EMU11
EMU10
EMU9
EMU8
EMU7
EMU6
EMU5
EMU4
EMU3
EMU2
EMU1
EMU0
RESET
号
AC2
D6
C6
AE4
AA2
V6
E15
B18
A18
A16
D14
D17
C17
B17
D16
A17
C16
B16
D15
C15
B15
C14
A15
P4
TYPE
(1)
IPD /
各国议会联盟
(2)
时钟/ PLL配置
I
I / O / Z
I / O / Z
I
I
A
(1)
I
O / Z
I
I
I
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
IPD
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
IPD
IPD
时钟输入。这个时钟是输入到片上PLL 。
在1/4的设备速度（O / Z） [默认]或该引脚可输出时钟
编程为1 GP0引脚（ I / O / Z） 。
在1/6的设备速度（O / Z） [默认]或该引脚可输出时钟
编程为GP0 2引脚（ I / O / Z） 。
时钟模式选择
选择是否在CPU时钟频率=输入时钟频率X1
（旁路） ， 5233 ，或X12 。
有关CLKMODE引脚的详细信息和PLL繁殖的因素，请参阅
该数据表的时钟PLL部分。
PLL供电电压
JTAG仿真
JTAG测试端口模式选择
JTAG测试端口的数据输出
在JTAG测试端口的数据
JTAG测试端口的时钟
JTAG测试端口复位。对于IEEE 1149.1 JTAG兼容，请参阅IEEE 1149.1
JTAG兼容声明本数据手册的部分。
仿真销11留作将来使用，悬空。
仿真销10留作将来使用，悬空。
仿真引脚9留作将来使用，悬空。
仿真引脚8留作将来使用，悬空。
仿真引脚7留作将来使用，悬空。
仿真引脚6留作将来使用，悬空。
仿真引脚5留作将来使用，悬空。
仿真引脚4.保留供以后使用，悬空。
仿真引脚3留作将来使用，悬空。
仿真引脚2保留供以后使用，悬空。
模拟引脚1
模拟引脚0
器件复位
不可屏蔽中断，边驱动（上升沿）
NMI
B4
I
IPD
注意：
在NMI引脚的噪声可能会触发一个NMI中断;因此，如果
NMI管脚没有被使用，则建议NMI引脚接地与
依托IPD 。
通用输入/输出（ GPIO）引脚（ I / O / Z）或外部中断（输入
只） 。
复位设置后，默认情况下是启用的GPIO输入只。
当这些引脚作为外部中断[通过选择
相应的中断使能寄存器位（ IER [7 ： 4] ） ，他们是边驱动
和极性可以通过外部中断被独立选择的
（ EXTPOL [3： 0]）极性寄存器位。
(5)
(5)
描述
复位，中断和通用输入/输出
GP0[7]/EXT_INT7
GP0[6]/EXT_INT6
GP0[5]/EXT_INT5
GP0[4]/EXT_INT4
E1
F2
F3
F4
I / O / Z
I / O / Z
I / O / Z
I / O / Z
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
(1)
(2)
(3)
(4)
(5)
I =输入， O =输出，Z =高阻抗， S =电源电压， GND =接地，A =模拟信号
IPD =内部下拉， IPU =内部上拉电阻。 （这些IPD / IPU信号引脚设有一个30 kΩ的IPD或IPU电阻。上拉一个信号
相反的电源轨， 1 kΩ电阻应使用。 ）
这些引脚复用引脚。欲了解更多详情，请参见本数据手册的设备配置部分。
PLLV不是外部电压供给部。请参阅有关如何连接这个引脚信息时钟PLL部分。
该EMU0和EMU1引脚内部上拉30 kΩ的电阻;因此，对于模拟和正常操作时，不需要外部
上拉/下拉电阻是必要的。然而，对于边界扫描操作，拉下EMU1和EMU0销专用
1 kΩ电阻。
设备概述
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TMS320DM643
2005-2010 ，德州仪器
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