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引脚排列房源
21
时钟
MPC8360E
e300内核
核心PLL
core_clk
该图中示出的时钟MPC8360E内的内部分布。
csb_clk
ce_clk以QUICC引擎模块
DDRC1
/2
ddr1_clk
QUICC
发动机
PLL
DDRC2
系统
PLL
时钟
单位
LB_CLK
/n
本地
总线/ DDRC2 LBIU
调节器
DLL
csb_clk休息
该装置的
CFG_CLKIN_DIV
CLKIN
PCI时钟
分频器
PCI_CLK_OUT [0： 2]
PCI_CLK /
PCI_SYNC_IN
/2
MEMC2_MCK [0：1 ]
MEMC2_MCK [0：1 ]
DDRC2
内存
设备
MEMC1_MCK [0： 5]
MEMC1_MCK [0： 5]
DDRC1
内存
设备
LCLK [0： 2]
LSYNC_OUT
LSYNC_IN
本地总线
内存
设备
PCI_SYNC_OUT
图54. MPC8360E时钟子系统
MPC8360E / MPC8358E的PowerQUICC II Pro处理器版本2.x的TBGA硅硬件规格修订版5
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飞思卡尔半导体公司
