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引脚排列房源
表66. MPC8360E TBGA引脚上市（续）
信号
LCLK[2]/LCS[7]
LSYNC_OUT
LSYNC_IN
G37
F34
G35
可编程中断控制器
MCP_OUT
IRQ0/MCP_IN
IRQ[1]/M1SRCID[4]/M2SRCID[4]/
LSRCID[4]
IRQ[2]/M1DVAL/M2DVAL/LDVAL
IRQ[3]/CORE_SRESET
IRQ [ 4 ：5]
IRQ[6]/LCS[6]/CKSTOP_OUT
IRQ[7]/LCS[7]/CKSTOP_IN
E34
C37
F35
F36
H34
G33, G32
E35
H36
DUART
UART1_SOUT/M1SRCID[0]/
M2SRCID[0]/LSRCID[0]
UART1_SIN/M1SRCID[1]/
M2SRCID[1]/LSRCID[1]
UART1_CTS/M1SRCID[2]/
M2SRCID[2]/LSRCID[2]
UART1_RTS/M1SRCID[3]/
M2SRCID[3]/LSRCID[3]
E32
B34
C34
A35
I
2
C接口
IIC1_SDA
IIC1_SCL
IIC2_SDA
IIC2_SCL
D34
B35
E33
C35
QUICC引擎模块
CE_PA[0]
CE_PA [1： 2]
CE_PA [ 3:7 ]
CE_PA[8]
CE_PA [ 9:12 ]
CE_PA [ 13:14 ]
CE_PA[15]
CE_PA[16]
CE_PA [ 17:21 ]
F8
AH1 ， AG5
F6 ，D4， C3 ，E5， A3的
AG3
F7 ，B3 ，E6 B4
AG1 ， AF6
B2
AF4
B16 ， A16 ， E17 ， A17 ， B17
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
LV
DD0
OV
DD
LV
DD
0
OV
DD
LV
DD
0
OV
DD
LV
DD
0
OV
DD
LV
DD
1
—
—
—
—
—
—
—
—
—
I / O
I / O
I / O
I / O
OV
DD
OV
DD
OV
DD
OV
DD
2
2
2
2
O
I / O
I / O
O
OV
DD
OV
DD
OV
DD
OV
DD
—
—
—
—
O
I
I / O
I / O
I / O
I / O
I / O
I / O
OV
DD
OV
DD
OV
DD
OV
DD
OV
DD
OV
DD
OV
DD
OV
DD
2
—
—
—
—
—
—
—
封装引脚数
PIN TYPE
O
O
I
动力
供应
OV
DD
OV
DD
OV
DD
笔记
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MPC8360E / MPC8358E的PowerQUICC II Pro处理器版本2.x的TBGA硅硬件规格修订版5
68
飞思卡尔半导体公司
