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TMS320C6414T , TMS320C6415T , TMS320C6416T
定点数字信号处理器
SPRS226M - 2003年11月 - 修订2009年4月
终端功能
信号
名字
TYPE
IPD /
IPU
时钟/ PLL配置
CLKIN
CLKOUT4/GP1§
CLKOUT6/GP2§
CLKMODE1
CLKMODE0
PLLV
TMS
TDO
TDI
TCK
TRST
EMU11
EMU10
EMU9
EMU8
EMU7
EMU6
EMU5
EMU4
EMU3
EMU2
H4
AE6
AD6
G1
H2
J6
AB16
AE19
AF18
AF16
AB15
AC18
AD18
AE18
AC17
AF17
AD17
AE17
AC16
AD16
AE16
I
I / O / Z
I / O / Z
I
I
A#
I
O / Z
I
I
I
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
I / O / Z
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
IPD
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
各国议会联盟
IPD
IPD
IPD
IPD
IPD
时钟输入。这个时钟是输入到片上PLL 。
在设备的速度( O / Z) [默认]或该引脚的1/4时钟输出可被编程为
GPIO引脚1 ( I / O / Z) 。
在设备的速度( O / Z) [默认]或该引脚的1/6时钟输出可被编程为
GPIO引脚2 ( I / O / Z) 。
时钟模式选择
选择是否在CPU时钟频率=输入时钟频率X1 (绕道) , 5233 ,或X12,
或X20 。有关CLKMODE引脚的详细信息和PLL繁殖的因素,看到时钟
本数据手册的PLL部分。
PLL供电电压
JTAG仿真
JTAG测试端口模式选择
JTAG测试端口的数据输出
在JTAG测试端口的数据
JTAG测试端口的时钟
JTAG测试端口复位。对于IEEE 1149.1 JTAG兼容,请参阅IEEE 1149.1 JTAG
本数据手册的兼容性声明部分。
仿真销11留作将来使用,悬空。
仿真销10留作将来使用,悬空。
仿真引脚9留作将来使用,悬空。
仿真引脚8留作将来使用,悬空。
仿真引脚7留作将来使用,悬空。
仿真引脚6留作将来使用,悬空。
仿真引脚5留作将来使用,悬空。
仿真引脚4.保留供以后使用,悬空。
仿真引脚3留作将来使用,悬空。
仿真引脚2保留供以后使用,悬空。
仿真[1 :0]引脚
选择操作的设备功能模式
手术
动车组[1:0 ]
00
边界扫描/正常模式(见注)
01
版权所有
10
版权所有
11
仿真/正常模式[默认](见IEEE 1149.1 JTAG
本数据手册的兼容性声明部分)
正常模式指的是DSP的正常操作模式中,当DSP是自由运行的。该
DSP可被置于正常操作模式下,当动车组[ 1:0]引脚被配置为
无论是边界扫描或仿真。
注意:当动车组[ 1 : 0]引脚配置为边界扫描模式下,内部下拉
(IPD)的TRST信号必须
反对为了在普通模式下进行操作。
对于边界扫描模式下拉动车组[ 1 : 0 ]引脚有专门的1kΩ电阻。
I =输入, O =输出, Z =高阻抗, S =电源电压, GND =接地
IPD =内部下拉, IPU =内部上拉电阻。 (这些IPD / IPU信号引脚设有一个30千欧的IPD或IPU电阻。为了拉起一个信号到相对
电源轨, 1 kΩ电阻应使用。 )
§这些引脚复用引脚。欲了解更多详情,请参见本数据手册的设备配置部分。
PLLV不是外部电源部分。请参阅有关如何连接这个引脚信息时钟PLL部分。
#A =模拟信号( PLL滤波器)
描述
EMU1
EMU0
AC15
AF15
I / O / Z
各国议会联盟
42
邮政信箱1443
休斯敦,得克萨斯州77251-1443

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