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SMJ320C80
数字信号处理器
SGUS025B - 1998年8月 - 修订2002年6月
架构
图1示出了' C80的主要组成部分是：主处理器（MP ） ，并行数字信号
处理器（聚苯硫醚） ，所述传输控制器（ TC），并且在IEEE- 1149.1仿真接口。以共享访问
片上RAM ，通过横杆实现。横杆连接由表示。每个PP可以
执行每个周期3访问通过其本地（ L）时，全局（ G）和指令（I）的端口。在MP可以访问
每个周期二个RAM通过其纵横/数据（ C / D）和指令（I）的端口，并在TC可以访问一个RAM中
通过交叉开关接口。多达九个同时访问在每个周期的支持。地址可以
可以改变每个周期，允许纵横制矩阵要在一个逐周期的基础上改变。争夺
对于同一RAM中同一周期处理器之间通过一个循环优先权方案得以解决。在
除了横梁，一个32位的数据路径中的MP和TC和VC之间存在。这使得在MP到
TC的访问控制寄存器是内存映射到MP内存空间。
在' C80具有4G字节的地址空间，如图2的下32M字节被用来解决内部
RAM和内存映射寄存器。
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