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表2-8 。的PCI地址和数据终端
终奌站
号
名字
AD31
AD30
AD29
AD28
AD27
AD26
AD25
AD24
AD23
AD22
AD21
AD20
AD19
AD18
AD17
AD16
AD15
AD14
AD13
AD12
AD11
AD10
AD9
AD8
AD7
AD6
AD5
AD4
AD3
AD2
AD1
AD0
C/BE3
C/BE2
C/BE1
C/BE0
PDV
171
172
175
176
178
179
167
181
184
186
187
188
189
190
191
192
205
206
207
208
173
1
2
3
5
7
8
9
10
11
12
13
164
193
204
4
GHK
E12
C12
A11
B11
E11
F11
F12
B10
F10
B09
C09
F09
E09
A08
B08
C08
B05
E06
C05
A04
B12
D01
E03
F05
E02
F03
F02
G05
F01
H06
G03
G02
B14
F08
F06
G06
I / O
描述
I / O
PCI地址/数据总线。这些信号构成了复用的PCI地址和数据总线上的主
界面。在一个主总线的PCI周期的地址段， AD31 - AD0包含一个32位的地址或
其他的目的地信息。在数据阶段， AD31 - AD0包含数据。
I / O
PCI总线命令和字节使能。这些信号被复用在相同的物理终端。中
初级PCI总线周期的地址相，C / BE3 -C / BE0定义总线命令。期间的数据
阶段，这4位总线被用作字节使能。该字节使能确定哪个字节的完整的32位的路径
数据总线进行有意义的数据。 C / BE0适用于0字节（ AD7 - AD0 ） ，C / BE1适用于1个字节（ AD15 - AD8 ）
C / BE2适用于2个字节（ AD23 - AD16 ） ，和C / BE3适用于3个字节（ AD31 - AD24 ） 。
PCI总线奇偶校验。在所有的PCI总线读写周期中， PCI1520计算整个偶校验
AD31 - AD0和C / BE3 -C / BE0巴士。至于在PCI周期的启动，将PCI1520输出这个平价
指示器具有一PCLK的延迟。如在PCI周期的目标，则PCI1520比较其计算出的奇偶性
向引发剂的奇偶性的指标。在奇偶校验错误（ PERR ）的断言一个比较错误的结果。
PAR
203
A05
I / O
213
