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OPA365-Q1
OPA2365-Q1
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SBOS512C - 2010年3月 - 修订2012年4月
+5V
C
1
100nF
V+
OPA365
V
V
IN
0至4.096V
可选
(2)
R
2
500
5V
C
2
100nF
SD1
BAS40
C
3(1)
1nF
R
1(1)
100
+ IN
ADS8326
16Bit
250kSPS
REF
I
+5V
+5V
In
REF3240
4.096V
C
4
100nF
图11.驾驶ADS8326
一种方法,用于驱动该否定的ADC需要一个输出摆幅降到0V使用略有
压缩ADC的满量程输入范围( FSR ) 。例如,在16位ADS8361 (示于
图12)
0V最大FSR为5V ,当由+ 5V电源和V供电
REF
的2.5V 。这样做是为了匹配ADC
输入范围与运算放大器满线性输出摆动范围;例如, 0.1至+ 4.9V的输出范围。该
从ADS8361 ADC基准输出使用一个电阻分压器分压为2.5V至2.4V 。该ADC
FSR就变成4.8V
PP
中心为+ 2.5V的共模电压。从ADS8361参考电流
引脚被限制在约± 10μA 。这里, 5μA ,采用偏置分压器。这些电阻必须精确保持
ADC的增益精度。这种方法的一个额外的好处是消除了负电源电压;它
不需要额外的电源电流。
R
2
10k
+5V
R
1
10k
C
1
100nF
V+
R
3(A)
100
OPA365
In
C
2(A)
1nF的+ IN
ADS8361
16Bit
100kSPS
N
裁判
UT REF我
+2.5V
R
4
20k
+2.4V
R
5
480k
+5V
V
IN
0.1V至4.9V
V
C
3
1F
图12.驾驶ADS8361
版权所有2010-2012 ,德州仪器
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