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引脚
8引脚排列
8.1 K20信号复用和引脚分配
下表显示了可用的每个引脚上的信号和它们的位置
在本文件所支持的设备引脚。端口控制模块负责
选择哪个ALT功能可每个引脚上。
48
LQFP
-QFN
1
2
3
4
5
6
7
8
9
10
11
12
13
引脚名称
默认
ALT0
ALT1
ALT2
ALT3
ALT4
ALT5
ALT6
ALT7
EzPort
VDD
VSS
USB0_DP
USB0_DM
VOUT33
VREGIN
ADC0_DP0
ADC0_DM0
VDDA
VREFH
VREFL
VSSA
VREF_OUT /
CMP1_IN5/
CMP0_IN5
XTAL32
EXTAL32
VBAT
PTA0
VDD
VSS
USB0_DP
USB0_DM
VOUT33
VREGIN
ADC0_DP0
ADC0_DM0
VDDA
VREFH
VREFL
VSSA
VREF_OUT /
CMP1_IN5/
CMP0_IN5
XTAL32
EXTAL32
VBAT
JTAG_TCLK /
SWD_CLK /
EZP_CLK
JTAG_TDI /
EZP_DI
JTAG_TDO /
TRACE_SWO /
EZP_DO
JTAG_TMS /
SWD_DIO
NMI_b /
EZP_CS_b
VDD
VSS
VDD
VSS
USB0_DP
USB0_DM
VOUT33
VREGIN
ADC0_DP0
ADC0_DM0
VDDA
VREFH
VREFL
VSSA
VREF_OUT /
CMP1_IN5/
CMP0_IN5
XTAL32
EXTAL32
VBAT
TSI0_CH1
PTA0
UART0_CTS_ FTM0_CH5
b/
UART0_COL_b
UART0_RX
UART0_TX
FTM0_CH6
FTM0_CH7
JTAG_TCLK /
SWD_CLK
JTAG_TDI
JTAG_TDO /
TRACE_SWO
JTAG_TMS /
SWD_DIO
NMI_B
EZP_CS_b
EZP_CLK
14
15
16
17
18
19
PTA1
PTA2
TSI0_CH2
TSI0_CH3
PTA1
PTA2
EZP_DI
EZP_DO
20
21
22
23
PTA3
PTA4/
LLWU_P3
VDD
VSS
TSI0_CH4
TSI0_CH5
VDD
VSS
PTA3
PTA4/
LLWU_P3
UART0_RTS_b FTM0_CH0
FTM0_CH1
K20次系列数据手册,第4 5/2012 。
56
飞思卡尔半导体公司

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