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ADS1294
ADS1296
ADS1298
SBAS459D - 2010年1月 - 修订2010年5月
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图33
示DRDY ， DOUT之间的SCLK期间的数据检索（的关系，以及在发生ADS1298的
与所选择的数据速率，给24位分辨率） 。 DOUT被锁存出在SCLK的上升沿。 DRDY是
高拉在SCLK的下降沿。注意， DRDY变为高上的第一个下降沿的SCLK而不管
是否数据被检索到从设备或命令被通过DIN引脚被发送。
DRDY
DOUT
215位
214位
213位
SCLK
图33. DRDY与数据检索（ CS = 0 ）
GPIO
该ADS1294 / 6/8总共有4个通用数字I / O（ GPIO ）引脚在正常模式下可用
操作。数字I / O引脚被单独配置为输入或输出，以通过GPIOC位
注册。将GPIO的GPIOD位控制管脚的电平。当读取GPIOD比特，则
返回的数据是管脚的逻辑电平，无论它们被编程为输入或输出。当GPIO
引脚被配置为输入，写入到相应GPIOD位无效。当被配置为
输出，在写GPIOD位设置输出值。
如果配置为输入，必须将这些引脚驱动（不浮动） 。 GPIO引脚被置后，为输入电
或复位后。
图34
示出了GPIO端口结构。该引脚应短接至DGND如果不使用。
GPIO1可以用作PACEIN信号; GPIO2复用RESP_BLK信号; GPIO3是复
与RESP信号;和GPIO4复用RESP_PH信号。
GPIO数据（读）
GPIO引脚
GPIO数据（写）
GPIO控制
图34. GPIO端口引脚
掉电（ PWDN ）
当PWDN拉低，所有片内电路断电。要退出掉电模式，采取PWDN引脚
高。当从掉电模式退出，内部振荡器和参考需要时间来唤醒。这是
建议在掉电期间外部时钟关闭以节省电力。
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2010 ，德州仪器
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