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TI380PCIA
PCI总线接口，用于TI380 COMMPROCESSORS
SPWS035 - 1997年6月
主板配置寄存器（板配置）构型的空间DWORD地址（ 0x44 ）
图14显示了主板配置寄存器的布局。
31
0
0
0
0
0
0
0
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0
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0
0
0
0
0
0
0
0
8
0
7
0
图14.主板配置寄存器布局
位00 - 07 ：
当RST驱动为高电平，对ROMA值[ 07:00 ]被锁存到主板配置寄存器
在TI380PCIA配置空间。罗姆[ 07:00 ]的值可以通过上拉和下拉提供
电阻在复位后不影响操作。此功能使设计人员能够支持跳线或
可以通过软件读取主板配置寄存器来感测板填料的选择。如果上拉和
下拉电阻都没有用，该板配置寄存器的内容复位后是不确定的。
位08 - 31 ：
这些位读为0 。
EEPROM读/写寄存器 - 配置空间DWORD地址（ ×48 ）
超前信息
图15示出了EEPROM的读/写寄存器的布局。表8描述了通过该8位4
注册。
15
RSVD
14
RSVD
13
RSVD
12
RSVD
11
RSVD
10
RSVD
9
RSVD
8
ECR-
CERR
7
NEP
6
ECLK
5
EEN
4
EDATA
3
RSVD
2
RSVD
1
RSVD
0
RSVD
RSVD =保留
图15. EEPROM读/写寄存器布局
表8. EEPROM读/写寄存器位说明
号
8
7
6
5
位
名字
ECRCERR
NEP
ECLK
EEN
描述
EEPROM CRC错误检测。 ECRCERR通常为0 ，但被设置为1 ，如果检测到错误，在CRC从读
在EEPROM上电。如果该位被置位， TI380PCIA还设置位7， NEP位。
EEPROM不存在。 NEP表示EEPROM接口被禁用或者通过在一个下拉电阻
EDIO销或通过在校验和错误的过程中对EEPROM下载过程的检测。
EEPROM的串行I / O （ SIO ）的时钟。 ECLK控制EDC引脚的状态。
1 =引脚为高电平
0 =引脚为低电平
EEPROM启用。 EEN控制EDIO针的方向。当此位被设置为1，则EDIO引脚被驱动以
在EDATA位的值。
EEPROM数据。 EDATA用于读取或写入在EEPROM中EDIO数据引脚。当位5是1 ，则EEPROM
数据引脚（ EDIO ）被驱动与该位的值。如果第5位是0 ，则该位变成1，因为EDIO是开漏
输出。
4
EDATA
28
邮政信箱1443
休斯敦，得克萨斯州77251-1443
