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AT8xC51SND1C
图6 。
模式切换波形
X1
X1
÷
2
X2位
时钟
STD模式
X2模式
(1)
STD模式
注意：
1.为了防止而X2模式下运行的任何不正确的操作，用户必须是
注意，使用的时钟频率作为时间基准（定时器等）的所有外围设备将
有自己的时间基准除以2。例如，一个自由运行的定时器产生
中断每20毫秒就会产生一个中断每10毫秒。
6.3 PLL
6.3.1 PLL说明
该AT8xC51SND1C PLL被用于产生内部高频时钟（ PLL的
时钟）与外部的低频率（振荡器时钟）同步。该PLL
时钟提供了MP3解码器，音频接口，和USB接口的时钟。
图7示出PLL的内部结构。
该PFLD块相位频率比较和锁定检测。此块
使得从所述N分频器和未来的基准时钟之间的比较
逆时钟从R分频器来了，就产生向上或向下一定的脉冲
信号根据反向时钟的边缘位置。在PLLCON PLLEN位
寄存器用于使所述时钟产生。当PLL处于锁定状态时，位PLOCK
在PLLCON寄存器（见表6 ）设置。
卫生防护中心块是电荷泵产生的VCO的电压基准
注入或提取连接PFILT引脚上的外部滤波器费（见
网络连接gure 8 ） 。过滤元件的值AR 详细参见“ DC
特性“ 。
VCO的块是压控振荡器的电压V控制
REF
亲
由电荷泵缩小一次。它产生一个方波信号： PLL时钟。
图7 。
PLL框图和符号
PLLCON.1
PFILT
PLLEN
N分频器
OSC
时钟
N6:0
Up
PFLD
下
PLOCK
PLLCON.0
卫生防护中心
VREF
VCO
PLL
时钟
R分频器
R9:0
OSCCLK
×
(
R + 1
)
PLLCLK
=
----------------------------------------------
-
N+1
PLL
时钟
PLL时钟符号
13
4109H–8051–01/05
