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开发支持
当出现超时，被中止，而不会影响内存或经营的目标模式MCU
系统。
定制串行协议要求调试盒知道目标BDC通信时钟速度。
时钟开关（ CLKSW ）在BDC状态和控制寄存器的控制位允许用户选择
BDC时钟源。 BDC时钟源可以是总线或备用的BDC时钟源。
BKGD引脚可以接收高或低电平，或发送高或低的水平。下图
显示了每种情况的时序。接口时序同步到目标BDC时钟，但
异步到外部主机。内部BDC时钟信号显示为计数基准
周期。
图12-2
表示外部主机发送逻辑1或0到目标HCS08 MCU的BKGD引脚。
主机是与目标异步，所以从主机产生下降沿一个0到1的循环延迟
以与目标所认为的位时间起始点。 10个目标BDC时钟周期后，目标
获得BKGD引脚的电平。通常情况下，主机积极驱动伪开漏BKGD引脚
在主机到目标传输到加速上升沿。因为目标不驱动BKGD
在主机到目标的传输周期针，也没有必要将线路作为漏极开路信号
在这个期间。
BDC时钟
（目标MCU ）
主持人
发送：1
主持人
TRANSMIT 0
10个循环
同步
不确定
知觉启动
BIT时间
对象感觉到位电平
最早开始
的下位
图12-2 。 BDC主机到目标串行位时序
图12-3
显示了主机从目标HCS08 MCU收到逻辑1 。由于主机
异步目标MCU ，有一个从在主机产生下降沿一个0到1的循环延迟
BKGD到目标MCU的感知到位开始。主机保持低BKGD引脚长
足以使目标识别它（至少两个目标BDC周期） 。主机必须释放低电平驱动
目标之前， MCU驱动一个简短的高电平加速脉冲七个周期的感知开始后
位时间。主机必须采样位电平大约10个周期后，启动位时间。
MC9S08QD4系列MCU数据手册，第6
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飞思卡尔半导体公司
