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飞思卡尔半导体公司
FOC [5 ： 1 ] - 强制输出比较
0 =没有任何意义
1 =使得编程为相应的OC脚脚动作，但OC标志未设置。
FOC [5： 1]对应的OC [5： 1] 。
FPWMA - 力PWMA价值
0 =正常PWMA操作
1 = F1A的值被驱动，不管PPROUT的状态列于PWMA销。
FPWMB - 力PWMB价值
0 =正常PWMB操作
1 = F1B的值驱动到PWMB销。
PPROUT - PWM时钟输出使能
在PWMA 0 =正常PWM操作
1 = TCNT时钟赶出PWMA脚
飞思卡尔半导体公司...
PPR [2： 0] - PWM分频器/ PCLK的选择
该字段选择七个分频器水龙头一个，或PCLK ，是PWMCNT输入。
PPR [2：0 ]
000
001
010
011
100
101
110
111
系统时钟
分频因子
2
4
8
16
32
64
128
PCLK
国家林业局 - PWMA慢/快选择
0 = PWMA周期为256 PWMCNT增量长。
1 = PWMA周期为32768 PWMCNT增量长。
SFB - PWMB慢/快选择
0 = PWMB周期为256 PWMCNT增量长。
1 = PWMB周期为32768 PWMCNT增量长。
下表显示了SF的设置上PWM频率的影响为16.78 MHz的系统时钟
和一个20.97 MHz的系统时钟。
PPR [2：0 ]
000
001
010
011
100
101
110
111
预分频器节拍
16.78 MHz的
20.97 MHz的
DIV 2 = 8.39 MHz的
2区= 10.5兆赫
DIV 4 = 4.19 MHz的
DIV 4 = 5.25 MHz的
DIV 8 = 2.10 MHz的
DIV 8 = 2.62 MHz的
DIV 16 = 1.05 MHz的股利16 = 1.31 MHz的
DIV 32 = 524千赫
DIV 32 = 655千赫
DIV 64 = 262千赫
DIV 64 = 328千赫
DIV 128 = 131 kHz的股利128 = 164千赫
PCLK
PCLK
SFA / B = 0
16.78 MHz的
20.97 MHz的
32.8千赫
41千赫
16.4千赫
20.5千赫
8.19千赫
10.2千赫
4.09千赫
5.15千赫
2.05千赫
2.56千赫
1.02千赫
1.28千赫
512赫兹
641赫兹
PCLK/256
PCLK/256
SFA / B = 1
16.78 MHz的
20.97 MHz的
256赫兹
320赫兹
128赫兹
160赫兹
64.0赫兹
80.0赫兹
32.0赫兹
40.0赫兹
16.0赫兹
20.0赫兹
8.0赫兹
10.0赫兹
4.0赫兹
5.0赫兹
PCLK / 32768 PCLK / 32768
F1A - 强制逻辑电平1上PWMA
PWMA引脚0 =强制逻辑电平输出为零
PWMA引脚1 =强制逻辑电平1输出
80
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MC68331TS/D
