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飞思卡尔半导体公司
MC145181
C寄存器的位
参见图13为C寄存器访问和串行数据
格式。
出A（ C7 ）
当输出引脚被选择为通用
输出（通过位r
i
21 = R
i
20 = 0），位C7确定状态
该引脚。当C7为1时，输出A被强制到一个较高的水平。
当C0为0输出A被拉低。
当输出A没有被选中作为通用
输出位C7没有任何功能;即， C7是一个“不关心”一下。
出B /外部参照（ C6 ）
位C6是一种两用位。
当MODE引脚接低电平， C6和C1 （ PLL备用） ，可
用于控制输出B.见表12 （参考
电路默认为晶体结构。 ）
当MODE引脚绑高，额外的控制
参考电路被允许。请参阅表13 。
PD
i
FLOAT（ C3 ）
该位控制的相位/频率检测器
二次回路，输出PDOUT
i
。当该位为0时，
二次相位检测器正常工作。当该位为
图1中，输出被强制为它打开浮动状态
循环，并允许调制到被引入外部
VCO输入。在这段时间内，计数器仍然有效。这
位从过程中影响相位检测器抑制
PDOUT
i
脉搏。
如果环路被锁定之前的C3被设置为1时，锁
探测信号从次级回路继续指示
PD后， “锁定”紧接
i
浮子被设置为1，如果相位
锁外循环漂移检测窗口，然后锁
检测信号表示“未锁定” 。如果循环没有被锁定，
和PD
i
浮子被设置为1 ，则该锁从检测信号
二次回路继续显示“未锁定” 。
OSC STBY （ C2 ）
该位控制晶体振荡器和外部
参考输入电路。当该位为0时，电路处于活动状态。
当该位为1时，该电路被关闭，并在
低功耗的待机模式。当该电路被关闭，一
保活振荡器的电压倍增器被激活时，
除非该倍频器在R经由位切断
i
注册。在
晶振模式下，当C2从1到0转换
状态，踢启动电路，是一家从事几毫秒。
开球启动电路可确保自启动的
正确设计的晶体振荡器
记
当C2为1 ，这两个位C1和C0必须
1 ，还。
为了尽量减少待机电源电流，电压倍增器
可能会被关闭（通过比特r
i
19, R
i
18和R
i
17为全
零） 。如果是这种情况，电压倍增器的功能是
被使用时，用户必须允许足够的时间使
相位/频率检测器的电源电压时泵出
乘法器带出备用。这种“泵出”时间就是
依赖于Cmult电容器的尺寸。泵电流
大约100
A.
在泵启动时间，无论是
PLL的待机位C1和C2必须是1或相位/
频率检测器浮子位C3和C4必须是1 。
PLL STBY （ C1 ）
当设置为1 ，该位则以主PLL在待机
模式，可降低功耗。 PDOUT喜
PDOUT罗被迫浮置状态时， N和R
计数器计数，抑制，主回路的输入
放大器被关闭时，Rx电流被抑制，并且在主
相位/频率检测器被关掉。基准振荡器
电路仍然活跃和C2位独立控制。
当该位被编程为0时，主PLL取
退出待机分两步进行。首先，输入放大器是
激活后，所有柜台都启用，并在Rx电流不
再抑制。任何FR和FV信号从抑制
切换相位/频率检测器和锁定检测器在
这次。第二，当FR脉冲出现时，N个计数器是
装，并且相位/频率和锁定检测器是
通过这两个触发器被复位初始化。紧接着
负载时， N和R的计数器开始递减计数在一起。
在这一点上， FR和FV脉冲被释放到相位
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输出C （ C5 ）
该位决定输出C引脚的状态。当C5
为1时，输出C被强制为高阻抗状态。当C5
为0 ，输出C被拉低。
PD浮动（ C4 ）
这个位控制对主回路的相位检测器，
输出PDOUT喜PDOUT罗。当该位为0，即主
相位检测器正常工作。当该位为1，则
输出被强制为它打开回路中的浮置状态的
并允许调制到被引入外部VCO
输入。在这段时间内，计数器仍然有效。该位
从期间PDOUT喜影响鉴相器抑制
或PDOUT罗脉冲。
如果环路被锁定之前的C4被设置为1时，锁
从主回路检测信号继续显示“锁定”
后立即PD浮法被设置为1，如果在循环的相
漂移锁外检测窗口，然后锁定检测
信号表示“未锁定” 。如果循环没有被锁定，和PD
浮子被设置为1 ，则该锁从主回路检测信号
继续显示“未锁定” 。
表12.输出B /位外部参照与模式引脚=低
位C1
0
态的
输出B引脚
低层
位C6
0
条件
主PLL
活跃
0*
1
1
1*
0
1
高阻抗*
高层
待机*
活跃
高阻抗
待机
*上电默认值。
表13.输出B /位外部参照与模式引脚=高
位C6
0*
1
参考CON组fi guration
支持水晶*
适应外部参考
*上电默认值。
摩托罗拉RF / IF设备数据
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