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M50FLW040A ， M50FLW040B
信号说明
有可在两个不同的总线接口
此设备。活动接口的选择之前，
电时，或者复位时，用接口
配置引脚， IC 。
各接口的信号在所讨论
固件集线器/低引脚数（ FWH / LPC ）信号
说明
部和
地址/地址
复用（A / A复用）信号说明
节
灰，分别同时供给信号显示
倔强的
供应信号说明
部分。
固件集线器/低引脚数（ FWH / LPC ）
信号说明
请参阅
图2中。
和
表1 ..
输入/输出通信（ FWH0 / LAD0-
FWH3/LAD3).
所有输入和输出通信
系统蒸发散与内存采取这些引脚的地方。
地址和数据总线读取和写入总线
操作编码在这些引脚。
输入
通讯
FRAME
(FWH4/
LFRAME ） 。
输入通信帧
（ FWH4 / LFRAME ）信号指示的开始
总线操作。当输入通信帧
是低电平，V
IL
上的时钟，一个新的上升沿
启动总线操作。如果输入通讯
帧是低，V
IL
，总线操作则在
操作中止。当输入交流
框架为高，V
IH
，当前总线操作的EI
疗法诉讼或总线处于空闲状态。
识别输入（ ID0 - ID3 ） 。
高达16 memo-
里斯可以解决的公共汽车上，在固件
集线器（ FWH ）模式。鉴定输入允许
每个设备被赋予一个唯一的4位地址。一
“0”是通过驱动其低，V所指上的销
IL
或
留浮动（因为有一个内部上拉
下拉电阻，与R的值
IL
） 。 A' 1'象征着
在一个引脚通过驱动为高电平，V
IH
（而且会有一个
我漏电流
LI2
通过销） 。
按照惯例，引导存储器必须具备AD-
礼服'0000' ，所有额外的记忆都giv-
连接地址，分配的顺序，从“0001” 。
在低引脚数（ LPC ）模式下， identifica-
化输入（ ID0 - ID2 ）可处理多达8 memo-
里斯在公共汽车上。在LPC模式中， ID3销是
留作将来使用（ RFU ） 。在AD-值
裙A19 -A21是相对于硬件strap-
平的ID0 - ID2引脚来选择内存
正在处理。一个地址位为'1'，
相应的ID引脚可悬空或
驱动为低电平，V
IL
（同样，随着内部下拉
电阻，与R的值
IL
） 。对于一个地址位
是' 0' ，则相应的ID引脚必须驱动
高，V
IH
（而且会有的泄漏电流的
I
LI2
通过销，如在规定的
表24. ） 。
为
详细信息，请参阅
表5 ..
通用输入（ GPI0 - GPI4 ） 。
该
通用输入，可作为数字输入
把用于CPU读取，其内容是
可在通用输入寄存器。
该引脚必须在整个烯稳定的数据
轮胎循环读取的通用输入
注册。这些引脚应被驱动为低电平，V
白细胞介素，
or
高，V
IH
，并且不得悬空。
接口配置（ IC） 。
该接口连接
成形的输入选择是否FWH / LPC IN-
terface或地址/地址复用（A / A
复用）接口使用。该接口的状态
配置方面， IC ，不应在改变
所述存储器装置的操作，除了对于选择
荷兰国际集团在此期间所需要的接口之前pow-
ER-或复位时。
要选择FWH / LPC接口，接口
配置引脚应保持浮动或驱动
低，V
IL
。要选择地址/地址多
路开关（A / A复用）接口，该引脚应driv-
EN为高电平，V
IH
。内部下拉电阻
包含R的值
IL
;将有漏电
当前的我
LI2
通过每个引脚时，拉至V
IH
.
接口复位（ RP ） 。
接口复位（ RP ）
输入用于复位器件。当界面
复位（ RP ）为低电平时，V
IL
中，存储器是在
复位模式（输出变为高阻抗，
和电流消耗最小化） 。当
RP驱动为高电平，V
IH
时，设备处于正常OP-
累加器。退出复位模式下，内存后恩
TER值读取模式。
CPU复位（ INIT ） 。
在CPU复位， INIT ，信号
用于重置设备时， CPU复位。
该行为相同界面进行重设，RP和
内部复位线是逻辑OR （电
AND） RP和INIT的。
时钟（CLK） 。
时钟（CLK）输入用于
时钟和输出输入/输出的信号
通信引脚， FWH0 / LAD0 - FWH3 / LAD3 。
时钟符合PCI规范。
顶块锁（ TBL ） 。
顶块锁定IN-
付诸使用，以防止顶座（方框7）从
被改变。当顶块锁， TBL ，是
驱动为低电平，V
IL
在编程和擦除操作
顶块是无效的，而不管
的锁定寄存器状态。当顶块锁，
TBL ，被驱动为高电平，V
IH
，块的保护
由锁定寄存器确定的。状态
顶块锁， TBL ，不影响保护
主块和灰（块06） 。有关详细信息，
SEE
附录A ..
顶块锁， TBL ，必须先设置一个亲
克或擦除操作被启动，并且必须
不被改变，直至操作完成后，
否则可能会出现无法预料的结果。西米
larly ，不可预知的行为是可能的，如果是WP
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