ICS307
串行可编程时钟源
描述
该ICS307-01和ICS307-02是多才多艺
串行可编程时钟源内搭
很小的电路板空间。
它们可以生成从6到任何频率
200兆赫,并具有第二可配置的
输出。该输出可以被重新编程上
飞,并锁定到一个新的频率,以10 ms
或更小。平滑的过渡(其中时钟
占空比仍然是50%左右) ,保证
如果输出分频器不改变。
该器件包括一个PDTS引脚,三态
输出时钟,掉电整个
芯片。
该ICS307-02拥有一个默认的时钟输出
在启动时,建议对所有新
设计。
特点
打包为16引脚窄体SOIC
高频率的精确
串行可编程:用户决定
通过3线接口输出频率。
无需进行定制石英
27兆赫 - 输入晶体5的频率
输出时钟频率高达200 MHz
掉电三态模式
非常低的抖动
操作的电压3.0至5.5 V
为TTL电平25毫安驱动能力
工业应用温度
框图
TTL
2
移
注册
3
2
R6:R0
7
VDD GND
SCLK
数据
频闪
C1:C0
S2:S0
F1:F0
9
V8:V0
产量
卜FF器
VCO
分频器
S2:S0
3
VCO
产量
分频器
PDTS
CLK1
晶体或
时钟输入
X1/ICLK
参考
分频器
相比较,
电荷泵,
和环路滤波器
水晶
振荡器
X2
功能
SELECT
2
F1:F0
产量
卜FF器
TTL
CLK2
C1:C0
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1
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集成电路系统公司 525赛街圣何塞 CA 95126 ( 408 ) 295-9800tel www.icst.com
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串行可编程时钟源
引脚分配
ICS307
X1/ICLK
NC
VDD
NC
GND
CLK2
NC
SCLK
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
X2
NC
NC
PDTS
数据
CLK1
NC
频闪
16引脚窄
( 0.150 “ ) SOIC
引脚说明
数
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
名字
X1/ICLK
NC
VDD
NC
GND
CLK2
NC
SCLK
频闪
NC
CLK1
数据
PDTS
NC
NC
X2
TYPE
XI
-
P
-
P
O
-
I
I
-
O
I
I
-
-
XO
描述
水晶连接( REF频率) 。连接到一个并联谐振晶体,或者输入时钟。
无连接。
连接到+ 3.3V或+ 5V 。
无连接。
连接到地面。
输出时钟2, F0 -F1确定。可以参考, REF / 2 , CLK1 / 2或关闭。
无连接。
串行时钟。参见时序图。
频闪加载数据。参见时序图。
无连接。
输出时钟1 ,由R0 - R6 , V0 -V8 , S0 -S2和输入频率决定。
数据输入。串行输入其设置输出时钟(S )三个字。
关断整个芯片,三态低CLK1和CLK2输出时。内部上拉。
无连接。
无连接。
输入晶体连接。连接到晶体或悬空的时钟输入。
类型: XI , XO =水晶连接, I =输入, O =输出, P =电源连接
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确定输出频率
上电时, ICS307-01片上的寄存器可以具有随机值,因此几乎任何频率可以是
从部分的输出。 CLK1总会有一些时钟信号存在,但CLK2也可能会被关闭
(低) 。
该ICS307-02片内寄存器进行初始配置,以提供一个x1的输出时钟都CLK1上
和CLK2输出。输出频率是一样的,输入时钟或晶体。这是有用的,如果
该ICS307将提供在上电时的初始系统时钟。因为这个特征是有利的,在大多数
系统中, ICS307-02建议用于新设计。
与编程,用户可以完全控制在改变所需输出频率,以在任何值
第4页表1中所示范围的ICS307的输出可通过以下简单的确定
公式:
CLK1频率=输入频率 2
哪里
(VDW+8)
(RDW+2)(OD)
VCO分频器字( VDW )= 4 511( 0,1, 2,3 ,不允许)
参考分频器字( RDW )= 1 127 ( 0是不允许的)
第4页上的输出分频器值=
此外,下面的操作范围应当观察:
(VDW+8)
55兆赫<输入频率 2 ( RDW + 2 )
200千赫<
输入频率
(RDW+2)
< 400兆赫
商业级温度范围。
工业级温度范围是
60兆赫到360兆赫。
以确定的VCO ,参考和输出分频器,接触的ICS应用的最佳组合
工程。您也可以发传真此页面集成电路可在408 295 9818 (传真) 。务必注明以下内容:
您的姓名________________公司Name___________________ Telephone_________________
通过e-mail (列表中选择您的E- mail地址) __________________or传真号码响应___________________
所需的输入crystal_______或clock_______ (以MHz为单位)所需的输出frequency_______________
REF Output_______VDD = 3.3V或5V _______占空比: 40%-60% _____或45-55 % required____
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设置器件特性
下面的表列出了可被配置,除了在VCO和参考分频器设置。
表1.输出分频和
最大输出频率
马克斯。频率。
CLK1
最大
产业
S2 S1 S0输出
频率
VERSION
DIVIDE
5 V或3.3 V
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
10
2
8
4
5
7
3
6
40
200
50
100
80
55
135
67
36
180
45
90
72
50
120
60
表2. CLK2输出
F1
0
0
1
1
F0
0
1
0
1
CLK2
REF
REF/2
关(低)
CLK1/2
0 =连接directy地
1 =直接连接到VDD
表3.输出占空比配置
TTL
0
1
测量占空比
1.4V
VDD/2
推荐VDD
5V
3.3 V
表4.晶体负载电容
C1
0
0
1
1
C0
0
1
0
1
VDD = 5 V
22.3 - 0.083 f
23.1 - 0.093 f
23.7 - 0.106 f
24.4 - 0.120 f
VDD = 3.3 V
22.1 - 0.094 f
22.9 - 0.108 f
23.5 - 0.120 f
24.2 - 0.135 f
注: TTL位优化的占空比
不同的VDD。当VDD为5 V ,设置为0
为近50%的占空比与TTL电平。
当VDD为3.3 V时,设置该位为1 ,所以
占空比为50%的在VDD / 2来实现的。
注: f为晶体频率,在10和
27兆赫。有效负载电容将更高
为晶振频率低于10MHz的。如果一个
时钟输入时,设置C1 = 0和C 0 = 0 。
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配置ICS307
该ICS307可以被编程来设置输出功能和频率。三个数据字节是
写入数据引脚,顺序如下:
C1 C0
TTL
F1 F0
最高位
S2
S1
S0
最低位
V8 V7 V6 V5 V4 V3 V2 V1
最高位
最低位
V0 R6 R5 R4 R3 R2 R1 R0
最高位
最低位
C1被加载到该端口的第一和R0的最后。
R6:R0
V8:V0
S2:S0
F1:F0
TTL
C1:C0
参考分频器字( RDW )
VCO分频器字( VDW )
输出分频器选择( OD)
CLK2输出功能
占空比设置
内部负载电容晶体
对于ICS 307-02上电默认值
0
0
1
0
0
0
1
1
0
0
0
0
0
1
0
0
0
0
0
0
0
1
1
0
输入频率将来自两个输出端。
编程示例
为了从一个14.31818 MHz的输入66.66 MHz时, RDW应该是59, VDW应该是276 ,
和输出分割为2选择最小内部负载电容的CMOS占空比,和CLK2
为OFF意味着下面的三个字节被发送到ICS307 :
00110001
1个字节
10001010
2字节
00111011
BYTE 3
如示于图2中,后在这24位被移入ICS307 ,服用STROBE为高电平将发送该数据
到内部锁存器,以及CLK输出会在10毫秒内锁定。
注:如果STROBE是在高状态和SCLK信号,数据被直接提供时钟到内部锁存
和输出条件,将相应地改变。虽然这不会损坏ICS307 ,它是
建议STROBE保持在较低水平,同时数据被移入ICS307 ,以避免
上的输出时钟意想不到的变化。
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