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ZL38010

低功耗四ADPCM代码转换器

数据表

特点

全双工转码四通道编码

和四通道解码

32 kbps的， 24 kbps和16 kbps的ADPCM编码

与ITU -T （前CCITT ） G.726符合

（无40 kbps的），和ANSI T1.303-1989

低功耗， 6.5 mW的典型

异步4.096 MHz主时钟操作

SSI和ST -BUS接口选项

透明PCM绕行

透明ADPCM绕行

线性PCM码

无需微处理器控制

简单的界面，编解码器设备

引脚可选

μ律

或A律操作

引脚可选的ITU - T或签署幅度PCM

编码

单3.3伏电源

订购信息

ZL38010DCE

28引脚SOIC

ZL38010DCF

28引脚SOIC

ZL38010DCE1 28引脚SOIC **

ZL38010DCF1 28引脚SOIC **

**无铅雾锡

-40 ° C至+ 85°C

管

磁带&卷轴

管

磁带&卷轴

2007年1月

应用

对增益

语音邮件系统

无线语音通信系统

描述

在四ADPCM代码转换器是一款低功耗， CMOS

设备能4编码和解码4

每帧的功能。四64kbps的PCM字节是

压缩成4个32 ， 24或16 kbps的ADPCM的词语，

和4 32 ， 24或16 kbps的ADPCM的词语是

扩展成4个64 kbps的PCM字节。 32 ， 24

和16kbps的ADPCM编码转换算法利用

符合ITU-T建议G.726 （不含

40 kbps的），和ANSI T1.303 - 1989年。

ADPCMi

ADPCMo

ADPCM

I / O

全双工

四

转码器

PCM

I / O

PCMo1

PCMi1

PCMo2

PCMi2

ENB1

ENB2/F0od

BCLK

F0i

MCLK

C2o

EN1

EN2

定时

控制解码

VDD VSS PWRDN IC

MS1 MS2 MS3 A / μ格式MS4 MS5 MS6线性SEL

图1 - 功能框图

卓联半导体公司

卓联， ZL和卓联半导体公司标识是卓联半导体公司的商标。

ZL38010

数据表

开关上的即时， 32 kbps和24 kbps的ADPCM之间，可以通过控制相应的模式选择

（ MS1 - MS6 ）控制引脚。该设备的所有可选功能引脚可选的，允许一个简单的界面，

行业标准的编解码器，数字电话设备和1层收发器。线性编码PCM被提供给

方便外接DSP功能。

变更摘要

从2005年10月期更改为2007年1月发行。

页面

项

订购信息箱

变化

新增了无铅部件编号。

EN1

MCLK

F0i

C2o

BCLK

PCMo1

PCMi1

VSS

线性

ENB2/F0od

ENB1

PCMo2

PCMi2

SEL

EN2

MS6

MS5

MS4

ADPCMo

ADPCMi

VDD

MS3

MS2

MS1

PWRDN

格式

图2 - 引脚连接

引脚说明

针＃

名字

EN1

描述

使能选通1 （输出）。

在B1在这8位宽度，高电平有效频闪活跃

在ST -BUS模式PCM通道。成为一个位，高电平有效脉冲时， LINEAR = 1 。

在SSI模式下，该输出为高阻态。

主时钟（输入）。

这是一个4.096兆赫（最低）输入时钟的使用

转码功能;它必须在这两种操作ST-总线和SSI模式来提供。

在ST- BUS模式C4 ST- BUS的时钟应用到该引脚。这个同步时钟

还用于控制对PCM和ADPCM的输入/输出管脚的数据的I / O流量

根据ST- BUS的要求。

在SSI模式此主时钟输入从一个外部源，并且可以是

异步相对于8kHz的帧。 MCLK速率高于4.096 MHz的

自从在数据I / O速率这种模式下可以接受由BCLK管辖。

F0i

C2o

帧脉冲（输入）。

帧同步脉冲输入的ST- BUS操作。 SSI

操作是通过此引脚连接到V启用

2.048 MHz时钟（输出）。

这种ST- BUS模式位时钟输出的MCLK （ C4 ）输入

进行二分频，反相，并同步到F0i 。这个输出是在高阻抗

SSI操作。

MCLK

卓联半导体公司

ZL38010

针＃

名字

BCLK

描述

数据表

位时钟（输入）。

128 kHz至4096 kHz的位时钟输入PCM和ADPCM端口;

在仅SSI的方式使用。这个时钟的下降沿锁存数据到ADPCMi ， PCMi1

和PCMi2 。边缘时钟上升沿数据出来ADPCMo ， PCMo1和PCMo2 。该输入

必须连接到V

对于ST- BUS操作。

串行PCM码流1 （输出）。

128 kbps到4096 kbps的串行压扩/线性PCM输出

放流。数据由上升BCLK的边缘SSI模式同步输出。主频由

MCLK在ST -BUS模式除以二。参见图14 。

串行PCM码流1 （输入）。

128 kbps到4096 kbps的串行压扩/线性PCM

输入流。数据在下降沿BCLK的边缘SSI模式移入。在移入

MCLK的ST -BUS模式3/4位的位置。参见图14 。

数字地。

名义上0伏

线性PCM选择（输入）。

当连接到V

在PCM I / O端口（ PCM1 ， PCM2 ）是16

位线性PCM 。线性PCM操作仅在2048 kbps的位速率。扩PCM是

当该引脚连接到V选择

。见图5 &图8 。

PCM B信道使能选2 （输入） /延迟帧脉冲（输出）。

SSI操作：

ENB2 （输入）。

一个8位宽的使能选通输入定义B2通道

（ AD）的PCM数据。一个有效的8位选通必须出现在此输入的SSI操作。看

图4 &图6 。

ST- BUS操作：

F0od （输出）。

该引脚是一个延迟的帧选通输出。 LIN-时

EAR = 0时，这将成为后发生64 C4的时钟周期的延迟的帧脉冲输出

F0i当LINEAR = 1 F0i后128 C4时钟周期。参见图7 ，8，9 & 14 。

PCMo1

PCMi1

线性

ENB2/F0od

ENB1

PCM B信道使能选通1 （输入）。

SSI操作：一个8位的使能选通输入定义B1通道（ AD）的PCM数据。一

有效8位选通，必须存在于本输入中的SSI操作。

ST- BUS操作：当连接到V

该ST-总线D-的透明旁路和C-信

内尔斯被启用。当连接到V

该ST-总线D信道和C信道输出的时隙

被强制为高阻抗状态。

PCMo2

串行PCM码流2 （输出）。

128 kbps到4096 kbps的串行压扩/线性PCM输出

放流。不断上升的BCLK的边缘SSI模式同步输出。主频由MCLK divid-

由两名在ST -BUS方式编。参见图14 。

串行PCM码流2 （输入）。

128 kbps到4096 kbps的串行压扩/线性PCM输入

流。数据位下降沿BCLK的边缘SSI模式移入。在移入

MCLK的ST -BUS模式3/4位的位置。参见图14 。

SELECT （输入）。

PCM旁路模式：当选择PCM搭桥手术SEL = 0 PCM1口

并且当选择用于PCM旁路操作SEL = 1时的PCM2端口。

见图6 &如图9所示。

16 kbps的转码方式：

SSI的操作 - 在16 kbps的代码转换模式下， ADPCM编码字被分配给I / O的

时隙由ENB2当SEL = 1和ENB1当SEL = 0定义。参见图4 。

ST-总线操作 - 在16 kbps的代码转换模式下， ADPCM编码字被分配给该

B2的时隙当SEL = 1时和给B1时隙当SEL = 0 。见图9 。

PCMi2

SEL

卓联半导体公司

ZL38010

针＃

名字

描述

数据表

A律/ μ律选择（输入）。

该输入引脚选择

μ律

当设置为扩

当设置为逻辑1，本控制逻辑0 ，而A律压扩是所有channels.This

输入线性模式时，它可连接到V忽视

或V

格式选择（输入）。

选择ITU -T PCM编码时高，登录幅度

PCM编码时低。这是控制输入的线性忽略所有channels.This

模式期间，它可以被连接到V

或V

掉电（输入）。

低电平有效复位强制器件进入低功耗模式

其中，所有输出为高阻抗和设备操作被暂停。

内部连接（输入）。

绑到V

以进行正常操作。

模式选择1 ， 2和3 （输入）。

模式选择为所有四个编码器。

模式

MS3 MS2 MS1

32kbps的ADPCM

24 kbps的ADPCM

在EN1 / ENB1 16kbps的ADPCM ，当SEL = 0

在EN2 / ENB2当SEL = 1

ADPCM绕道32 kbps和24 kbps的

ADPCM绕道16 kbps的

PCM旁路（ 64 kbps）即可满足PCM1如果SEL = 0 ， PCM2如果SEL = 1

算法复位（ ITU -T可选复位）

ADPCMo关闭

正电源。

标称3.3伏+/- 10％的

串行ADPCM流（输入）。

128 kbps到4096 kbps的串行ADPCM字的输入流。

数据位在时钟下降沿BCLK的边缘SSI模式，在主频上3/4位

MCLK的ST -BUS模式的优势。

串行ADPCM流（输出）。

128 kbps到4096 kbps的ADPCM串行输出的字

流。数据位的时钟由上升BCLK的边缘SSI模式和时钟由

MCLK在ST -BUS模式除以二。

模式选择4 ，图5和图6（输入）。

模式选择为所有四个解码器。

模式

MS6 MS4 MS5

32kbps的ADPCM

24 kbps的ADPCM

在EN1 / ENB1 16kbps的ADPCM ，当SEL = 0

在EN2 / ENB2当SEL = 1

ADPCM绕道32 kbps和24 kbps的

ADPCM绕道16 kbps的

PCM旁路（ 64 kbps）即可满足PCM1如果SEL = 0 ， PCM2如果SEL = 1

算法复位（ ITU -T可选复位）

PCMo1 / 2禁用

使能选2 （输出）。

在B2在这8位宽度，高电平有效频闪活跃

在ST -BUS模式PCM通道。强制为高阻抗时LINEAR = 1 。

格式

PWRDN

MS1

MS2

MS3

ADPCMi

ADPCMo

MS4

MS5

MS6

EN2

注意：

所有未使用的输入应连接到逻辑低或高，除非另有说明。所有输出应处于开路状态时，不能使用。

所有输入都有，除了MCLK具有CMOS兼容逻辑电平， PWRDN具有施密特触发器TTL兼容的逻辑电平

兼容逻辑电平。

所有输出均与CMOS逻辑电平CMOS （见DC电气特性）。

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ZL38010

功能说明

数据表

该四通道ADPCM代码转换器是一款低功耗， CMOS器件能够4编码和解码4

每帧的操作。四个64kbps的信道（PCM octets）被压缩成4个32 ， 24或16 kbps的ADPCM

通道（ADPCM话），和4 32 ， 24或16 kbps的ADPCM通道（ADPCM字）被扩展成四个

64kbps的PCM声道（ PCM八位字节）。所采用的ADPCM编码转换算法符合ITU -T

建议G.726 （不含40 kbps的），和ANSI T1.303 - 1989年间的切换和32上的飞

24 kbps的转码，可以通过切换相应的模式选择引脚（支持T1劫位信令）。

设备支持的所有功能可通过引脚选择。四个编码功能包括一个共同的基

通过模式选择引脚MS1 ， MS2和MS3控制。类似地，四个解码函数形成第二组

通过模式选择引脚MS4 ， MS5和MS6共同控制的。所有其他引脚控制是通用于整个

转码器。

该装置需要6.5毫瓦（ MCLK = 4.096兆赫），通常为四通道转码操作。最低

完成4编码通道和四个解码所需的电路的4.096 MHz主时钟频率

每帧的通道。对于SSI操作比4.096 MHz和异步主时钟频率更高，

相对于8kHz的帧，是允许的。

对PCM和ADPCM串行总线支持ST- BUS和同步串行接口（ SSI ）的操作。这

允许串行数据的时钟速率从128千赫到4096千赫，以及兼容卓联的标准的串行

电信总线（ST- BUS）。对于ST- BUS操作，对片内通道计数器提供通道使能输出，以及

为2048千赫比特时钟输出可用于通过利用SSI总线接口下游的设备。

还支持线性PCM编码。在这种模式下，编码器压缩， 4个14位的二的补

（S，S ，S 12 ，...， 1,0），均匀的PCM信道分成四个4,3或2比特的ADPCM通道。类似地，译码器扩展

4 4,3或2比特的ADPCM通道成4个16位的二的补码（ S， 14 ，...， 1,0），均匀的PCM信道。该

数据速率为ST-总线和SSI操作在该模式下为2048 kbps的。

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