Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
产品特点
为110MHz时钟支持
TM
支持的PowerPC ， Intel和RISC处理器
9时钟输出：驱动多达18载
LVPECL输入参考时钟
输出禁用控制
扩频兼容
3.3V电源
引脚兼容MPC953
工业级温度范围。范围：-40 ° C至+ 85°C
32引脚TQFP封装
频率表
BYPASS ＃ PLL_EN VCO_SEL Q（ 0 ： 7 ）
0
0
0
REF
0
0
1
REF
0
1
0
REF
0
1
1
REF
1
0
0
REF/4
1
0
1
REF/8
1
1
0
VCO/4
1
1
1
VCO/8
表1
Fb_out分别
REF
REF
REF
REF
REF/4
REF/8
VCO/4
VCO/8
功能表
BYPASS ＃
MR / OE ＃
VCO_SEL
PLL_EN
' 1 ' =使能PLL
“0”= PLL旁路
' 1 ' =输出禁用成为HiZ
“0”=输出启用
'1'= VCO / 2
“0”= VCO
' 1 ' =选择VCO
' 0 ' =选择PECL_CLK
表2
框图
引脚配置
VCO_SEL
BYPASS ＃
Fb_out分别
PLL_EN
VDDC
27
VSS
VSS
25
24
23
22
21
20
19
18
17
16
Fb_out分别
32
31
30
29
28
PECL_CLK
PECL_CLK ＃
FB_IN
相
探测器
VCO
200-500M
LPF
/4
/2
7
Q(0:6)
Q7
VCO_SEL
BYPASS ＃
MR / OE ＃
PLL_EN
VDD
FB_IN
NC
NC
NC
NC
VSS
PECL_CLK
1
2
3
4
5
6
7
8
9
26
Q0
Z9953
10
11
12
13
14
15
Q1
VDDC
Q2
VSS
Q3
VDDC
Q4
VSS
PECL_CLK ＃
VSS
Q7
Q6
MR / OE ＃
VDDC
图1
赛普拉斯半导体公司
http://www.cypress.com
文件编号： 38-07086牧师* B
VDDC
Q5
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第1页6
Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
最大Ratings
最大输入电压相对于VSS ： VSS - 0.3V
最大输入电压相对于VDD ： VDD + 0.3V
存储温度：
工作温度：
最高ESD保护
最大电源：
最大输入电流：
-65 ° C至+ 150°C
-40 ° C至+ 85°C
2KV
5.5V
±20mA
该器件包含电路，以保护输入
不受损坏，由于高静电压或电
场;然而，应采取预防措施，以避免
应用高于最大值的任何电压的
额定电压至该电路。为了正常工作，输入电压
和Vout的应被约束的范围内
VSS< （VIN或Vout）外部<VDD
未使用的输入必须始终连接到一个适当的
逻辑电压电平（ VSS或VDD） 。
DC参数
特征
输入低电压
输入高电压
输入低电平电流（ @VIL = VSS ）
输入高电流（ @VIL = VDD ）
峰 - 峰值输入电压
PECL_CLK
共模范围
PECL_CLK
输出低电压
输出高电压
静态电源电流
PLL电源电流
输入电容
符号
VIL
VIH
IIL
IIH
VPP
VCMR
VOL
VOH
IDDC
国际直拨电话
CIN
VDD-
0.6
-
-
-
-
15
-
20
20
4
民
VSS
2.0
典型值
-
-
最大
0.8
VDD
-120
120
1000
VDD-
0.6
0.6
单位
V
V
A
A
mV
V
V
V
mA
mA
pF
IOL = 20mA时，注4
IOH = -20mA ，注4
所有VDDC和VDD
只有VDD
条件
注2
注3
300
VDD-
1.5
-
VDD = VDDC = 3.3V
±
5 ％ ， TA = -40 ° C至+ 85°C
°
°
注1 ：
对任何输入或I / O引脚上的电压不能超过电期间的电源引脚。电源排序不
所需。
注2 ：
输入有上拉，下拉电阻影响的输入电流。
注3 ：
该VCMR是从差分输入信号的最正侧的差。获得正常运行时，
“高”输入是VCMR范围内与输入在于将VPP规范内。
注4 ：
驱动串联或并联终止50Ω （或50Ω至VDD / 2 ）的传输线。输出缓冲器上演双控制
为了减少上/下射推动力量。
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第3页6
Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
AC参数
符号
TR / TF
FREF
FrefDC
FVCO
TLOCK
TR / TF
FOUT
1
参数
TCLK输入上升/下降
参考输入频率
参考输入占空比
PLL VCO锁定范围
最大PLL锁定时间
2
民
25
25
200
4,5
典型值
最大
3.0
110
75
500
10
1.0
110
62.5
200
单位
ns
兆赫
%
兆赫
ms
ns
兆赫
条件
输出时钟的上升/下降时间
0.10
50
25
0.8V至2.0V
VCO_SEL ='0'
VCO_SEL ='1'
旁路模式
最大输出频率
FoutDC
TCCJ
TSKEW
tPD的
tpZL ，
tpZH
tPLZ ，
tPHZ
tPD的
输出占空比
4,5
45
50
55
100
%
ps
ps
ps
ns
ns
ns
循环周期抖动（峰
4,5
峰）
任何输出到任何输出偏斜
输入FB_IN延迟（ PLL
3,4,5
锁定）
输出使能时间（所有输出）
输出禁止时间（所有输出）
输入Q延迟（ PLL旁路）
3
4,5
-
-75
-
-
250
125
6
7
7
VDD = VDDC = 3.3V +/- 5 ％ ， TA = -40 ° C至+ 85°C
°
°
注1 ：
参数通过设计和特性保证。不是100 ％生产测试。
注2 ：
最大和最小输入值是由VCO锁定范围的限制。
注3 ：
该TPD （ PLL锁定）是输入参考频率相关。
注4 ：
驱动串联或并联的端接50Ω （或50Ω至VDD / 2 ）的传输线。
注5 ：
输出满载30pF的各
描述
在Z9953是一个基于PLL的时钟发生器，可提供低偏移和低抖动时钟输出的高性能
系统。在Z9953采用差分PLL来最小化周期到周期和相位抖动。该PLL是
确保给定的，该压控振荡器构成为200MHz的至500MHz之间运行的稳定运行。
输入参考的差分LVPECL时钟。所有其他的控制输入是LVCMOS / LVTTL兼容
在Z9953设有9个LVCMOS / LVTTL兼容输出每个可驱动两个系列的50Ω端接
传输线。有了这个功能的Z9953拥有一个有效的扇出1:18 。输出也可以是三态时，
MR / OE ＃被设置为高。
时作为零延迟缓冲器使用任何的9输出可以被用作反馈输入到PLL。该PLL工程
对齐与输入参考边缘，从而产生一个接近零延迟的输出边。
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第4 6
Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
32引脚TQFP封装外形尺寸
D
符号
A
A
1
A2
D
1
10°
A
1
A
2
A
L
e
b
D
D
1
b
e
L
0.018
民
-
0.002
0.037
-
-
0.012
英寸
喃
-
-
-
0.354
0.276
-
0.031 BSC
-
0.030
0.45
最大
0.047
0.006
0.041
-
-
0.018
民
-
0.05
0.95
-
-
0.30
MILLIMETERS
喃
-
-
-
9.00
7.00
-
0.80 BSC
-
0.75
最大
1.20
0.15
1.05
-
-
0.45
订购信息
产品型号
套餐类型
生产流程
Z9953AA
32引脚TQFP
工业， -40 ° C至+ 85°C
注意：
订购型号是由设备号，设备版本，包装样式的组合形成的，
筛选如下所示。
标记：
例如：
柏
Z9953AA
日期代码，批号＃
Z9953AA
包
A = TQFP
调整
设备号
通告
赛普拉斯半导体公司保留更改产品的权利，以提高设计，
性能或可靠性。赛普拉斯半导体公司对使用其产品在生命的不负责
支承和医疗应用中产品的失效或故障可能导致生命的失败
支持和医疗系统。产品未被授权用于此类应用，除非书面批准
制造商要求，并批准给予书面赛普拉斯半导体公司为使用其
配套产品在生活和医疗应用
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Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
产品特点
为110MHz时钟支持
TM
支持的PowerPC ， Intel和RISC处理器
9时钟输出：驱动多达18载
LVPECL输入参考时钟
输出禁用控制
扩频兼容
3.3V电源
引脚兼容MPC953
工业级温度范围。范围：-40 ° C至+ 85°C
32引脚TQFP封装
频率表
BYPASS ＃ PLL_EN VCO_SEL Q（ 0 ： 7 ）
0
0
0
REF
0
0
1
REF
0
1
0
REF
0
1
1
REF
1
0
0
REF/4
1
0
1
REF/8
1
1
0
VCO/4
1
1
1
VCO/8
表1
Fb_out分别
REF
REF
REF
REF
REF/4
REF/8
VCO/4
VCO/8
功能表
BYPASS ＃
MR / OE ＃
VCO_SEL
PLL_EN
' 1 ' =使能PLL
“0”= PLL旁路
' 1 ' =输出禁用成为HiZ
“0”=输出启用
'1'= VCO / 2
“0”= VCO
' 1 ' =选择VCO
' 0 ' =选择PECL_CLK
表2
框图
引脚配置
VCO_SEL
BYPASS ＃
Fb_out分别
PLL_EN
VDDC
27
VSS
VSS
25
24
23
22
21
20
19
18
17
16
Fb_out分别
32
31
30
29
28
PECL_CLK
PECL_CLK ＃
FB_IN
相
探测器
VCO
200-500M
LPF
/4
/2
7
Q(0:6)
Q7
VCO_SEL
BYPASS ＃
MR / OE ＃
PLL_EN
VDD
FB_IN
NC
NC
NC
NC
VSS
PECL_CLK
1
2
3
4
5
6
7
8
9
26
Q0
Z9953
10
11
12
13
14
15
Q1
VDDC
Q2
VSS
Q3
VDDC
Q4
VSS
PECL_CLK ＃
VSS
Q7
Q6
MR / OE ＃
VDDC
图1
赛普拉斯半导体公司
525洛Coches街
加利福尼亚州米尔皮塔斯95035电话： 408-263-6300 ，传真： 408-263-6571
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VDDC
Q5
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第1页6
Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
引脚说明
针
8
9
12, 14, 16,
18, 20, 22,
24, 26
28
名字
PECL_CLK
PECL_CLK ＃
Q(7:0)
PWR
I / O
I
I
O
描述
PECL输入时钟。
PECL输入时钟。
时钟输出。
VDDC
Fb_out分别
VDDC
O
2
10
FB_IN
MR / OE ＃
I
I
30
PLL_EN
I
31
32
11, 15, 19,
23, 27
1
7, 13, 17, 21,
25, 29
3, 4, 5, 6
BYPASS ＃
VCO_SEL
VDDC
VDD
VSS
NC
I
I
反馈时钟输出。连接到FB_IN正常
操作。旁路电容的延迟，在此输出将
控制输入参考/输出的相位关系。
反馈时钟输入。连接到Fb_out分别访问
该PLL 。
主复位/输出使能输入。当置为高电平，
复位所有的内部触发器，并禁用所有的
输出。当拉低，释放内部触发器
自复位，使所有的输出。
PLL选择输入。当置为高电平， VCO输出
选择。而当设定为低， PECL_CLK是输入到
输出分频器。
PLL使能输入。当高， PLL使能时
低时， PLL被旁路。
VCO分频器选择输入。当设置为高， VCO输出
除以2时设定得低，分频器被旁路。
3.3V电源的输出时钟缓冲器。
3.3V电源的PLL
共同点
无连接
PD =内部下拉， PU =内部上拉电阻。
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525洛Coches街
加利福尼亚州米尔皮塔斯95035电话： 408-263-6300 ，传真： 408-263-6571
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第2 6
Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
最大额定值
最大输入电压相对于VSS ： VSS - 0.3V
最大输入电压相对于VDD ： VDD + 0.3V
存储温度：
工作温度：
最高ESD保护
最大电源：
最大输入电流：
-65 ° C至+ 150°C
-40 ° C至+ 85°C
2KV
5.5V
±20mA
该器件包含电路，以保护输入
不受损坏，由于高静电压或电
场;然而，应采取预防措施，以避免
应用高于最大值的任何电压的
额定电压至该电路。为了正常工作，输入电压
和Vout的应被约束的范围内
VSS< （VIN或Vout）外部<VDD
未使用的输入必须始终连接到一个适当的
逻辑电压电平（ VSS或VDD） 。
DC参数
特征
输入低电压
输入高电压
输入低电平电流（ @VIL = VSS ）
输入高电流（ @VIL = VDD ）
峰 - 峰值输入电压
PECL_CLK
共模范围
PECL_CLK
输出低电压
输出高电压
静态电源电流
PLL电源电流
输入电容
符号
VIL
VIH
IIL
IIH
VPP
VCMR
VOL
VOH
IDDC
国际直拨电话
CIN
VDD-
0.6
-
-
-
-
15
-
20
20
4
民
VSS
2.0
典型值
-
-
最大
0.8
VDD
-120
120
1000
VDD-
0.6
0.6
单位
V
V
A
A
mV
V
V
V
mA
mA
pF
IOL = 20mA时，注3
IOH = -20mA ，注3
所有VDDC和VDD
只有VDD
条件
注1
注2
300
VDD-
1.5
-
VDD = VDDC = 3.3V
±
5 ％ ， TA = -40 ° C至+ 85°C
°
°
注1 ：
输入有上拉，下拉电阻影响的输入电流。
注2 ：
该VCMR是从差分输入信号的最正侧的差。获得正常运行时，
“高”输入是VCMR范围内与输入在于将VPP规范内。
注3 ：
驱动串联或并联终止50Ω （或50Ω至VDD / 2 ）的传输线。输出缓冲器上演双控制
为了减少上/下射推动力量。
赛普拉斯半导体公司
525洛Coches街
加利福尼亚州米尔皮塔斯95035电话： 408-263-6300 ，传真： 408-263-6571
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Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
AC参数
符号
TR / TF
FREF
FrefDC
FVCO
TLOCK
TR / TF
FOUT
1
参数
TCLK输入上升/下降
参考输入频率
参考输入占空比
PLL VCO锁定范围
最大PLL锁定时间
2
民
25
25
200
4,5
典型值
最大
3.0
110
75
500
10
1.0
110
62.5
200
单位
ns
兆赫
%
兆赫
ms
ns
兆赫
条件
输出时钟的上升/下降时间
0.10
50
25
0.8V至2.0V
VCO_SEL ='0'
VCO_SEL ='1'
旁路模式
最大输出频率
FoutDC
TCCJ
TSKEW
tPD的
tpZL ，
tpZH
tPLZ ，
tPHZ
tPD的
输出占空比
4,5
45
50
55
100
%
ps
ps
ps
ns
ns
ns
循环周期抖动（峰
4,5
峰）
任何输出到任何输出偏斜
输入FB_IN延迟（ PLL
3,4,5
锁定）
输出使能时间（所有输出）
输出禁止时间（所有输出）
输入Q延迟（ PLL旁路）
3
4,5
-
-75
-
-
250
125
6
7
7
VDD = VDDC = 3.3V +/- 5 ％ ， TA = -40 ° C至+ 85°C
°
°
注1 ：
参数通过设计和特性保证。不是100 ％生产测试。
注2 ：
最大和最小输入值是由VCO锁定范围的限制。
注3 ：
该TPD （ PLL锁定）是输入参考频率相关。
注4 ：
驱动串联或并联的端接50Ω （或50Ω至VDD / 2 ）的传输线。
注5 ：
输出满载30pF的各
描述
在Z9953是一个基于PLL的时钟发生器，可提供低偏移和低抖动时钟输出的高性能
系统。在Z9953采用差分PLL来最小化周期到周期和相位抖动。该PLL是
确保给定的，该压控振荡器构成为200MHz的至500MHz之间运行的稳定运行。
输入参考的差分LVPECL时钟。所有其他的控制输入是LVCMOS / LVTTL兼容
在Z9953设有9个LVCMOS / LVTTL兼容输出每个可驱动两个系列的50Ω端接
传输线。有了这个功能的Z9953拥有一个有效的扇出1:18 。输出也可以是三态时，
MR / OE ＃被设置为高。
时作为零延迟缓冲器使用任何的9输出可以被用作反馈输入到PLL。该PLL工程
对齐与输入参考边缘，从而产生一个接近零延迟的输出边。
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Z9953
3.3V ， 180MHz的，多输出零延迟缓冲器
32引脚TQFP封装外形尺寸
D
符号
A
A
1
A2
D
1
10°
A
1
A
2
A
L
e
b
D
D
1
b
e
L
0.018
民
-
0.002
0.037
-
-
0.012
英寸
喃
-
-
-
0.354
0.276
-
0.031 BSC
-
0.030
0.45
最大
0.047
0.006
0.041
-
-
0.018
民
-
0.05
0.95
-
-
0.30
MILLIMETERS
喃
-
-
-
9.00
7.00
-
0.80 BSC
-
0.75
最大
1.20
0.15
1.05
-
-
0.45
订购信息
产品型号
套餐类型
生产流程
Z9953AA
32引脚TQFP
工业， -40 ° C至+ 85°C
注意：
订购型号是由设备号，设备版本，包装样式的组合形成的，
筛选如下所示。
标记：
例如：
柏
Z9953AA
日期代码，批号＃
Z9953AA
包
A = TQFP
调整
设备号
通告
赛普拉斯半导体公司保留更改产品的权利，以提高设计，
性能或可靠性。赛普拉斯半导体公司对使用其产品在生命的不负责
支承和医疗应用中产品的失效或故障可能导致生命的失败
支持和医疗系统。产品未被授权用于此类应用，除非书面批准
制造商要求，并批准给予书面赛普拉斯半导体公司为使用其
配套产品在生活和医疗应用
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